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WO2018168680A1 - アクティブマトリクス基板及び表示パネル - Google Patents

アクティブマトリクス基板及び表示パネル Download PDF

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WO2018168680A1
WO2018168680A1 PCT/JP2018/009171 JP2018009171W WO2018168680A1 WO 2018168680 A1 WO2018168680 A1 WO 2018168680A1 JP 2018009171 W JP2018009171 W JP 2018009171W WO 2018168680 A1 WO2018168680 A1 WO 2018168680A1
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terminal group
terminal
wiring
substrate
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陽介 藤川
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シャープ株式会社
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    • H10D86/481—Integrated devices formed in or on insulating or conducting substrates, e.g. formed in silicon-on-insulator [SOI] substrates or on stainless steel or glass substrates characterised by multiple TFTs integrated with passive devices, e.g. auxiliary capacitors

Definitions

  • the present invention relates to an active matrix substrate and a display panel.
  • display devices including a display panel such as a liquid crystal panel are used for portable information terminal devices such as mobile phones, smartphones, and tablet laptop computers, and electronic devices such as computers.
  • a display panel such as a liquid crystal panel
  • electronic devices such as computers.
  • an active matrix substrate constituting a display panel pixels are arranged in a matrix, and wiring terminals led out from the pixels are arranged along one side of the active matrix substrate.
  • the terminal arrangement relating to the active matrix substrate for example, those described in Patent Documents 1 to 5 below are known.
  • Patent Document 1 describes a configuration in which, among a plurality of terminals, the pitch between terminals arranged at the end in the arrangement direction is larger than the pitch between terminals arranged at the center in the arrangement direction.
  • Patent Document 2 describes a configuration in which the area of terminals arranged at the end in the arrangement direction and the pitch between terminals are larger than the area of terminals arranged at the center in the arrangement direction and the pitch between terminals.
  • Patent Document 3 describes a configuration in which a terminal associated with a source bus line, a terminal associated with a gate bus line, and a terminal associated with a common electrode are arranged along one side of the active matrix substrate.
  • Patent Document 3 the terminals related to the source bus lines are divided into three terminal groups, and the terminal groups related to the gate bus lines are arranged outside the terminal groups related to the source bus lines.
  • Patent Document 4 describes a configuration in which a terminal related to a source bus line and a terminal related to a gate bus line are formed on one side of an active matrix substrate and are alternately arranged in the one side direction. .
  • terminal arrangement modes in the active matrix substrate described in Patent Documents 1 to 4 are summarized as follows (1) to (3).
  • the plurality of terminals are basically arranged at equal intervals and have the same area.
  • the arrangement pitch may be increased to increase the mounting accuracy, or the area may be increased to reduce the resistance.
  • terminals having different functions may be alternately arranged in one side direction of the substrate.
  • Patent Document 5 describes an in-cell type liquid crystal display panel with a built-in touch panel function, and a terminal related to a source bus line, a terminal related to a gate bus line, and a terminal related to a common electrode are formed on one side of an active matrix substrate. The configuration is described. In an active matrix substrate with a built-in touch panel function as described in Patent Document 5, it is possible to detect the touch position by dividing the common electrode.
  • the present invention has been completed based on the above circumstances, and an object thereof is to narrow the frame of an active matrix substrate.
  • an active matrix substrate of the present invention includes a substrate, a plurality of pixel electrodes provided on the substrate and arranged in a matrix along a row direction and a column direction, and the substrate.
  • a plurality of switching elements connected to each of the plurality of pixel electrodes, a plurality of common electrodes provided on the substrate, and provided at one end in the column direction on the substrate, in the row direction.
  • a terminal group configured by a plurality of first terminals and a plurality of second terminals arranged along the length, wherein the length in the row direction is the length of the arrangement region of the plurality of switching elements in the row direction and the row A group of terminals set to a value smaller than the length of the arrangement area of the plurality of common electrodes in the direction, and the plurality of switches provided on the substrate and arranged in the column direction with the first terminals.
  • a plurality of common electrode wirings that electrically connect the second terminal and the plurality of common electrodes, respectively, and the terminal group is a central terminal group constituting a central portion in the row direction of the terminal group
  • a center side terminal group constituted by a plurality of the first terminals arranged along the row direction and an end side terminal group constituting both side portions of the terminal group in the row direction
  • Two first terminals that are constituted by the plurality of first terminals arranged along the row direction and the plurality of second terminals arranged along the row direction, and the second terminals are adjacent in the row direction.
  • the end-side terminal group are arranged between, that comprises a characteristic.
  • the plurality of wirings are directed to the terminal group.
  • the terminal group are arranged in a focused manner.
  • the length of the wiring in the row direction increases as the degree of convergence of the wiring increases, more wirings are arranged in the column direction.
  • the wiring arrangement space in the column direction becomes large due to the width of each wire and the interval between adjacent wires.
  • the end side terminal group has a configuration in which the first terminal and the second terminal are mixed.
  • the length in the row direction of several 1st terminals, and The length in the row direction of the plurality of second terminals can be further increased. That is, the degree of convergence of the plurality of switching element wirings and the degree of convergence of the plurality of common electrode wirings can be reduced. As a result, the arrangement space in the column direction related to the switching element wiring and the common electrode wiring can be further reduced, so that the frame of the active matrix substrate can be narrowed.
  • the length of the terminal group in the row direction is set to a value smaller than the length of the arrangement region of the plurality of switching elements and the length of the arrangement region of the plurality of common electrodes. For this reason, the space which arrange
  • the switching element wiring may be electrically connected to a source electrode of the switching element, and the third terminal may be electrically connected to a gate electrode of the switching element. .
  • the terminals related to the switching elements and the common electrode can be arranged in the row direction, and the arrangement space in the column direction related to the terminals can be further reduced.
  • a display panel according to the present invention includes the above-described active matrix substrate and a counter substrate disposed to face the active matrix substrate. According to the display panel having such a configuration, the frame size of the active matrix substrate is reduced, so that the design of the display panel is high.
  • positioning aspect of the terminal of the comparative example 1 The top view which shows the arrangement
  • positioning aspect of the terminal of the comparative example 5 The top view which shows the arrangement
  • FIG. 1 A first embodiment of the present invention will be described with reference to FIGS.
  • a part of each drawing shows an X axis, a Y axis, and a Z axis, and each axis direction is drawn to be a direction shown in each drawing.
  • the liquid crystal display device 10 supplies a liquid crystal panel 11 (display panel), a driver 17 (panel driving unit) that drives the liquid crystal panel 11, and various input signals to the driver 17 from the outside.
  • the backlight device 14 includes a chassis 14A having a substantially box shape that opens toward the front side (the liquid crystal panel 11 side), and a light source (not shown), such as a cold cathode tube, disposed in the chassis 14A. LED, organic EL, etc.) and an optical member (not shown) arranged to cover the opening of the chassis 14A.
  • the optical member has a function of converting light emitted from the light source into a planar shape.
  • the liquid crystal display device 10 includes a pair of front and back exterior members 15 and 16 for housing and holding the liquid crystal panel 11 and the backlight device 14 assembled to each other.
  • the front side exterior member 15 is formed with an opening 15 ⁇ / b> A for allowing an image displayed in the display area A ⁇ b> 1 of the liquid crystal panel 11 to be visually recognized from the outside.
  • the liquid crystal display device 10 includes, for example, a mobile phone (including a smartphone), a notebook computer (including a tablet notebook computer), a wearable terminal (including a smart watch), a portable information terminal (electronic (Including books and PDAs), portable game machines, and digital photo frames (not shown).
  • the liquid crystal panel 11 is a substance that is disposed between a pair of substrates 21 and 22 arranged in a facing manner and between the pair of substrates 21 and 22, and whose optical characteristics change as an electric field is applied.
  • a liquid crystal layer 23 (medium layer) containing liquid crystal molecules and a seal member 24 disposed between the pair of substrates 21 and 22 and sealing the liquid crystal layer 23 by surrounding the liquid crystal layer 23 are provided.
  • the front side (front side, upper side in FIG. 1) of the pair of substrates 21 and 22 is the CF substrate 21 (counter substrate), and the back side (rear side) substrate is the active matrix substrate 22 (array substrate, element side substrate). ).
  • the liquid crystal molecule contained in the liquid-crystal layer 23 is set as horizontal alignment, for example, it is not limited to this.
  • polarizing plates are attached to the outer surface sides of both the substrates 21 and 22, respectively.
  • the CF substrate 21 is configured by laminating a color filter, an overcoat film, and an alignment film (all not shown) on the inner surface side (liquid crystal layer 23 side) of a glass substrate (not shown).
  • the color filter includes three colored portions (not shown) of R (red), G (green), and B (blue) arranged in a matrix. Each colored portion is disposed to face each pixel (see FIG. 4) of the active matrix substrate 22.
  • the active matrix substrate 22 includes a glass substrate 26 (substrate) and various films laminated on the inner surface side (the liquid crystal layer 23 side, the upper side in FIG. 3) of the glass substrate 26.
  • the base coat film 28 the semiconductor film 33, the gate insulating film 32, the gate conductive film 31, the insulating film 35, the conductive film 34, the planarizing film 36, and the wiring 72 are sequentially arranged from the lower layer side.
  • the insulating film 39, the pixel electrode 40, the insulating film 41, and the common electrode 42 are stacked.
  • the base coat film 28 has a solid pattern covering the entire surface of the glass substrate 26, and is made of, for example, silicon oxide (SiO2), silicon nitride (SiNx), silicon nitride oxide (SiNO), or the like.
  • the semiconductor film 33 is laminated on the base coat film 28 and constitutes a channel part (semiconductor part) connected to the source electrode 34S and the drain electrode 34D in the TFT 43.
  • the semiconductor film 33 is made of low-temperature polysilicon (LTPS).
  • the gate insulating film 32 is laminated on the upper side of the base coat film 28 and the semiconductor film 33.
  • the gate conductive film 31 is composed of a single layer film made of one kind of metal material (for example, tantalum or tungsten), a laminated film made of different kinds of metal materials, an alloy, or the like, and has conductivity and light shielding properties. is doing.
  • the gate conductive film 31 constitutes a gate wiring 31A (see FIG. 4), a gate electrode 31G of the TFT 43, and the like. That is, the gate wiring 31A and the gate electrode 31G are arranged in the same layer.
  • the insulating film 35 is stacked on the upper layer side of the gate insulating film 32 and the gate conductive film 31.
  • the conductive film 34 is laminated on the upper layer side of the insulating film 35 and is a single-layer film made of one kind of metal material (for example, aluminum (Al) or chromium copper (Cr)) or a laminated film made of different kinds of metal materials. Further, it is made of an alloy or the like and has conductivity and light shielding properties.
  • the conductive film 34 constitutes a source wiring 34A (see FIG. 2), a source electrode 34S and a drain electrode 34D of the TFT 43, and the like. That is, the conductive film 34 can be called a source conductive film and a drain conductive film, and the source wiring 34A, the source electrode 34S, and the drain electrode 34D are arranged in the same layer.
  • the planarizing film 36 is laminated on the upper side of the conductive film 34 and the insulating film 35 and is made of, for example, an acrylic resin material (for example, polymethyl methacrylate resin (PMMA)) that is an organic resin material.
  • the flattening film 36 is an organic insulating film, and the film thickness thereof is thicker than other inorganic insulating films (insulating films 32, 35, 39, 41), and has a function of flattening the surface.
  • the wiring 72 is, for example, one of copper (Cu), titanium (Ti), molybdenum (Mo), aluminum (Al), magnesium (Mg), cobalt (Co), chromium (Cr), tungsten (W), or these A mixture of The insulating film 39 is laminated on the upper side of the planarizing film 36 and the wiring 72.
  • the pixel electrode 40 is disposed on the insulating film 39 and is made of a film of a transparent electrode material (for example, ITO (Indium Tin Oxide)).
  • the insulating film 41 is stacked on the upper side of the pixel electrode 40 and the insulating film 39.
  • the common electrode 42 is disposed on the insulating film 41 and is configured by a film of a transparent electrode material (for example, ITO).
  • the gate insulating film 32, the insulating film 35, the insulating film 39, and the insulating film 41 are inorganic insulating films made of an inorganic material such as silicon nitride (SiNx) or silicon oxide (SiO2), and have moisture resistance. .
  • a TFT 43 as a switching element is provided corresponding to the pixel electrode 40.
  • the TFT 43 includes a gate electrode 31G, a semiconductor film 33, a source electrode 34S, and a drain electrode 34D.
  • a contact hole CH1 is formed at a location overlapping the drain electrode 34D so as to penetrate the planarizing film 36 and the insulating film 39.
  • the pixel electrode 40 is connected to the drain electrode 34D through the contact hole CH1.
  • contact holes CH ⁇ b> 2 are formed at positions overlapping the wiring 72 so as to penetrate the insulating films 39 and 41.
  • the contact hole CH2 is opened to the liquid crystal layer 23 side (upper side in FIG.
  • the common electrode 42 is connected to the wiring 72 through the contact hole CH2. Further, contact holes CH4 and CH5 are formed so as to penetrate the gate insulating film 32 and the insulating film 35, respectively.
  • the source electrode 34S is connected to the semiconductor film 33 through the contact hole CH4.
  • the drain electrode 34D is connected to the semiconductor film 33 through the contact hole CH5.
  • the liquid crystal panel 11 has a display area A1 that can display an image and a non-display area A2 that is arranged on the outer peripheral side so as to surround the display area A1.
  • the display area A1 is formed in an inner portion of an area where the CF substrate 21 and the active matrix substrate 22 overlap.
  • the CF substrate 21 and the active matrix substrate 22 each have a rectangular shape, and the active matrix substrate 22 projects from the CF substrate 21 on one side in the Y-axis direction.
  • the peripheral edge portion on one side in the Y-axis direction of the active matrix substrate 22 is a region that does not overlap with the CF substrate 21, and terminals 61, 62, and 63 (details will be described later) are formed in this region.
  • circuit members such as the driver 17 and the flexible substrate 13 are appropriately connected to the terminals 61, 62, and 63.
  • the driver 17 may be mounted on the flexible substrate 13 (COF mounting), and in this case, each terminal (mainly terminals 61 and 62) is connected to the driver 17 via the flexible substrate 13.
  • the display area A1 is arranged in a matrix along the X-axis direction (row direction) and the Y-axis direction (column direction).
  • a plurality of pixels 27 are provided.
  • gate drivers 18 are provided at both ends in the X-axis direction.
  • an RGB switch circuit 45 is provided between the formation region of the plurality of pixels 27 and the terminals 61, 62, and 63.
  • the pixel 27 includes a pixel electrode 40, a common electrode 42, and a TFT 43.
  • the pixel electrodes 40 are provided on the glass substrate 26, and a plurality of pixel electrodes 40 are arranged in a matrix along the X-axis direction (one side direction of the glass substrate 26) and the Y-axis direction (the other side direction of the glass substrate 26).
  • a plurality of TFTs 43 are arranged in a matrix along the X-axis direction and the Y-axis direction.
  • the TFT 43 is provided at a location where the gate wiring 31 ⁇ / b> A and the source wiring 34 ⁇ / b> A intersect, and the plurality of TFTs 43 are connected to the plurality of pixel electrodes 40, respectively.
  • the TFT 43 is driven based on various signals respectively supplied to the gate wiring 31A and the source wiring 34A, and a predetermined voltage is applied to the pixel electrode 40 with the driving.
  • the common electrode 42 is a solid electrode, and when a potential difference is generated between the pixel electrode 40 having a plurality of slits (not shown) and the common electrode 42, the common electrode 42 is interposed between the common electrode 42 and the pixel electrode 40. Generates a fringe electric field (an oblique electric field) including a component in the normal direction to the plate surface of the active matrix substrate 22 in addition to the component along the plate surface of the active matrix substrate 22. Thereby, an image can be displayed on the display area A1 by controlling the alignment state of the liquid crystal molecules contained in the liquid crystal layer 23 (see FIG. 1) using the fringe electric field.
  • a fringe electric field an oblique electric field
  • the gate driver 18 has a long shape in the Y-axis direction, is monolithically formed on the glass substrate 26, and has a control circuit for controlling the supply of output signals to the TFT 43. ing.
  • the gate lines 31A extending along the Y-axis direction are respectively connected to the gate drivers 18 on both sides.
  • a plurality of wirings 73 are drawn from the gate driver 18.
  • a terminal 63 (third terminal) is provided at the end of the wiring 73 opposite to the gate driver 18. That is, the terminal 63 is electrically connected to the gate electrode 31G of the TFT 43 via the wiring 73, the gate driver 18, and the gate wiring 31A.
  • a control signal is supplied to the gate driver 18 from, for example, the control circuit board 12 (see FIG. 1) via the terminal 63 and the wiring 73.
  • the configuration in which the gate driver 18 is disposed at both ends in the X-axis direction on the glass substrate 26 is exemplified, but the present invention is not limited to this.
  • the gate driver 18 may be disposed only at one end in the X-axis direction.
  • the gate driver 18 that drives the even-numbered gate wiring 31A is arranged on one side in the X-axis direction
  • the gate driver 18 that drives the odd-numbered gate wiring 31A is X It may be arranged on the other side in the axial direction.
  • the RGB switch circuit 45 is monolithically formed on the glass substrate 26 like the gate driver 18 and is formed along one side (X-axis direction) around the pixel array. Three source wirings 34 A corresponding to the red, green, and blue pixels 27 are connected to one wiring 71 via the RGB switch circuit 45.
  • a terminal 61 (first terminal) is provided at the end of the wiring 71 (switching element wiring) opposite to the RGB switch circuit 45.
  • the wiring 71 is provided on the glass substrate 26 and is a wiring for electrically connecting the terminal 61 and a plurality of TFTs 43 (source electrode 34S) arranged in the Y-axis direction, and corresponds to each of the plurality of terminals 61. A plurality of them are provided.
  • the wiring 71 drawn out from the RGB switch circuit 45 extends toward the terminal 61 along the Y-axis direction, then extends in a direction inclined with respect to the Y-axis, and then extends to the terminal 61 along the Y-axis direction. It extends in the form of heading.
  • the RGB switch circuit 45 has a function of distributing an image signal included in an output signal supplied from the driver 17 side to each source wiring 34A. As a result, it is possible to perform RGB three-primary color display by changing the transmittance of each color pixel 27.
  • the configuration in which one wiring 71 is connected to the three source wirings 34A is exemplified, but the present invention is not limited to this.
  • one wiring 71 may be distributed to two source wirings 34A, or one wiring 71 may be distributed to four source wirings 34A.
  • the liquid crystal panel 11 has a display function for displaying an image and a touch panel function (position input function) for detecting a position (input position) input by the user based on the displayed image.
  • the touch panel pattern for demonstrating the touch panel function is integrated (in-cell).
  • This touch panel pattern is a so-called projected capacitance method, and its detection method is a self-capacitance method.
  • the touch panel pattern includes a plurality of common electrodes 42 provided on the glass substrate 26 as shown in FIG. That is, the common electrode 42 functions as a position detection electrode.
  • the plurality of common electrodes 42 are arranged in a matrix along the X-axis direction and the Y-axis direction.
  • the area of the common electrode 42 is set to a value larger than the area of the pixel electrode 40, and one common electrode 42 is disposed to face the plurality of pixel electrodes 40.
  • An example of the arrangement region of one common electrode 42 is indicated by reference numeral A3 in FIG.
  • the common electrode 42 is connected to one end of a wiring 72 (common electrode wiring) provided on the glass substrate 26.
  • a terminal 62 is provided at the other end of the wiring 72. That is, the wiring 72 is configured to electrically connect the plurality of terminals 62 and the plurality of common electrodes 42 respectively.
  • a common voltage is applied to the common electrode 42 via the terminal 62 and the wiring 72.
  • the control circuit board 12 supplies a drive signal for detecting the input position to the common electrode 42 via the driver 17, the terminal 62 and the wiring 72, and also detects the input position. For receiving a detection signal.
  • the number (number of divisions) of the common electrodes 42 is appropriately set according to the resolution of touch sensing and the size of the display screen. For example, in the case of a 5-6 type wide screen liquid crystal panel, the number of divisions is set to about 500 to 600. In the following description, the number of common electrodes 42 is assumed to be n.
  • the wiring 72 drawn from the common electrode 42 extends to the terminal 62 side along the Y-axis direction, then extends in a direction inclined with respect to the Y-axis, and then heads toward the terminal 62 along the Y-axis direction. It extends in.
  • the wiring 72 is arranged so as to overlap the pixel array in the Z-axis direction (thickness direction of the active matrix substrate 22). Therefore, as shown in FIG.
  • the wiring 72 is formed of a conductive film different from the conductive film 31 for the gate and the conductive film 34 (the conductive film for the source and the drain conductive film), and has a different layer (the conductive film for the gate). 31 and the conductive film 34).
  • a terminal group constituted by the terminals 61 is referred to as a first terminal group
  • a terminal group constituted by the terminals 62 is referred to as a second terminal group
  • a terminal group constituted by the terminals 63 is referred to as a third terminal group.
  • a plurality of terminals 61, 62, 63 are provided on one end portion in the Y-axis direction on the glass substrate 26, and are arranged linearly along the X-axis direction.
  • the length of the terminal group 60 in the X-axis direction is the length of the arrangement region of the plurality of TFTs 43 and the arrangement of the plurality of common electrodes 42.
  • the length of the area is set to a value smaller than the length of the arrangement area of the RGB switch circuit 45. For this reason, as shown in FIG. 5, the plurality of wirings 71 are narrowed in a fan shape toward the first terminal group (first terminal group 1AC, 1AL, 1AR) constituted by the terminal 61 from the RGB switch circuit 45.
  • the plurality of wirings 72 are formed so as to be narrowed in a fan shape from the plurality of common electrodes 42 toward the second terminal groups 2AL and 2AR.
  • the terminals 61, 62, and 63 have the same shape and area, for example. In FIG. 5, the terminal 63 is not shown.
  • the terminal group 60 includes a central terminal group 64 that constitutes a central portion in the X-axis direction, and end-side terminal groups 65L and 65R that respectively constitute both side portions in the X-axis direction.
  • the center side terminal group 64 is configured by a plurality of terminals 61 (first terminal group 1AC) arranged along the X-axis direction.
  • the end side terminal groups 65 ⁇ / b> L and 65 ⁇ / b> R are configured by a terminal 61 and a terminal 62.
  • the end-side terminal group 65L includes a plurality of terminals 61 (first terminal group 1AL) and a plurality of terminals 62 (second terminal group 2AL) arranged along the X-axis direction.
  • the end-side terminal group 65R includes a plurality of terminals 61 (first terminal group 1AR) and a plurality of terminals 62 (second terminal group 2AR) arranged along the X-axis direction.
  • the end side terminal groups 65L and 65R are arranged so as to sandwich the center side terminal group 64 from both sides in the X-axis direction.
  • the number of wirings 71 is determined by the number of pixels 27 and the number of source wirings 34A to which one wiring 71 is assigned by the RGB switch circuit 45. In the case of portrait display in a liquid crystal panel used for a cellular phone, the number of wirings 71 is 1080 at the resolution of FHD (1080 ⁇ 1920), and the number of wirings 71 is at the resolution of WQHD (1440 ⁇ 2560). In many cases, the number is 1440 or 2160. In the following description, the number of wirings 71 is N. That is, the total number of terminals 61 is N.
  • the wiring 71 is constituted by, for example, the gate conductive film 31 or the conductive film 34.
  • the first terminal group 1AL is arranged on the left side of the first terminal group 1AC, and the first terminal group 1AR is arranged on the right side of the first terminal group 1AC.
  • a plurality of terminals 61 are arranged at equal intervals with an arrangement pitch d1.
  • a plurality of terminals 61 are arranged at equal intervals with an arrangement pitch D1.
  • the arrangement pitch D1 is set to be twice the arrangement pitch d1, for example.
  • the first terminal group 1AC and the first terminal group 1AL are adjacent to each other at a pitch D1, and the first terminal group 1AC and the first terminal group 1AR are adjacent to each other at a pitch d1 or D1. That is, the first terminal group 1AL, 1AC, 1AR can be regarded as an array of a total of N terminals 61 whose array pitch has changed during the process.
  • the number of wirings 72 and terminals 62 is the same as the number n of common electrodes 42, respectively. As described above, since N is generally 1080, 1440, 2160, and n is 500 to 600, it is general that n ⁇ N.
  • a terminal 62 is disposed between two terminals 61 adjacent to each other at the arrangement pitch D1.
  • a plurality of terminals 62 are arranged at equal intervals with an arrangement pitch D2.
  • the arrangement pitch D2 is set to a value equal to the arrangement pitch D1.
  • the terminals 61 and the terminals 62 are alternately arranged.
  • the number of terminals 61 and 62 is shown to be smaller than the actual number, with 36 terminals 61 and 18 terminals 62. It is shown.
  • one wiring group 72 (half of all wiring lines 72) is formed in a fan-shaped manner (converging shape) toward the second terminal group 2AL.
  • the other group of wirings 72 is formed so as to be narrowed down in a fan shape toward the second terminal group 2AR.
  • the wiring 72 is arranged in a different layer from the wiring 71, and a situation where interference with the wiring 71 is prevented.
  • the wiring 72 may be arranged in a different layer from the wiring 71 only in a place where the wiring 72 and the wiring 71 overlap.
  • the wiring 72 is formed in a layer different from the RGB switch circuit 45 and is arranged so as to overlap the RGB switch circuit 45 in plan view.
  • the third terminal groups 3AL and 3AR configured by a plurality of terminals 63 are respectively arranged on both sides in the X-axis direction with respect to the terminal group 60. That is, in FIG. 4, when one side of the glass substrate 26 is viewed from the left side, the third terminal group 3AL, the terminal group 60 (end side terminal group 65L, center side terminal group 64, end side terminal group 65R), The three terminal groups 3AR are arranged in this order. As shown in FIG. 4, in the X-axis direction, the length of the terminal group 60 is smaller than the length of the pixel array composed of the plurality of pixels 27. For this reason, even when the third terminal groups 3AL and 3AR are arranged on both sides of the terminal group 60, the situation in which the length of the active matrix substrate 22 in the X-axis direction becomes large is suppressed.
  • the terminal 63 is a terminal related to the gate wiring 31A of the pixel 27, but its application is not limited to this.
  • the terminal 63 may be a terminal for the wiring 74 related to the control of the RGB switch circuit 45 as shown in FIG.
  • an inspection terminal (not shown) of the liquid crystal panel 11 may be disposed, or a mark for manufacturing and managing a product or a product with a patterned product name may be provided.
  • the power source may be electrically connected across two or more terminals 63.
  • a terminal 62 is disposed between two adjacent terminals 61.
  • the configuration is as follows. That is, the end side terminal groups 65L and 65R are configured such that the terminals 61 and 62 are mixed. Thereby, it is assumed that the central portion of the terminal group 60 is composed of only the plurality of terminals 61 and both side portions of the terminal group are composed of only the plurality of terminals 62 (refer to the terminal group in FIG. 6 and will be described in detail later).
  • the lengths of the plurality of terminals 61 in the X-axis direction (the total length of the first terminal groups 1AL, 1AC, 1AR) and the lengths of the plurality of terminals 62 in the X-axis direction (second terminal groups 2AL, 2AR) Each length) can be made larger. That is, the degree of convergence of the plurality of wirings 71 (the amount of narrowing W1A in FIG. 5) and the degree of convergence of the plurality of wirings 72 (the amount of narrowing W2A and W2A1 in FIG. 5) can be reduced. As a result, the arrangement space in the Y-axis direction (the frame dimension LA in the Y-axis direction) related to the wiring 71 and the wiring 72 can be further reduced, so that the active matrix substrate 22 can be narrowed.
  • each of the terminals 63 is provided on the glass substrate 26, arranged on both sides in the X-axis direction with respect to the terminal group 60, and includes a plurality of terminals 63 arranged along the X-axis direction.
  • a third terminal group 3AL, 3AR is provided.
  • the length of the terminal group 60 in the X-axis direction is set to a value smaller than the length of the arrangement region of the plurality of TFTs 43 and the length of the arrangement region of the plurality of common electrodes 42. For this reason, the space which arrange
  • the wiring 71 is electrically connected to the source electrode 34S of the TFT 43, and the terminal 63 is electrically connected to the gate electrode 31G of the TFT 43.
  • the terminals 61, 62, and 63 related to the TFT 43 and the common electrode 42 can be arranged along the X-axis direction, and the arrangement space in the Y-axis direction related to the terminals 61, 62, and 63 can be further increased. Can be small.
  • Comparative Examples 1 to 5 the arrangement of the terminals 61 and 62 is different from that of the present embodiment, and other configurations are the same as those of the present embodiment.
  • Comparative Examples 1 to 5 the total number of terminals 61 and the total number of terminals 62 are the same as in this embodiment. Further, in FIGS. 6 to 10 showing Comparative Examples 1 to 5, the terminal 63 is not shown.
  • a first terminal group 1B configured by a plurality of terminals 61 is provided, and second terminals configured by a plurality of terminals 62 on both sides in the X-axis direction of the first terminal group 1B.
  • Groups 2BL and 2BR are arranged, respectively.
  • the plurality of terminals 61 and 62 are arranged at equal intervals.
  • the plurality of wirings 71 extend from the RGB switch circuit 45 toward the first terminal group 1B and have a fan-like appearance as a whole.
  • one wiring group 72 is formed in a fan-shaped manner toward the second terminal group 2BL, and the other wiring group 72 is fan-shaped toward the second terminal group 2BR. It is formed in a narrowed form.
  • the length of the first terminal group 1B is smaller than the length of the first terminal group of this embodiment (the combined length of the first terminal groups 1AL, 1AC, 1AR).
  • the terminals 61 are arranged at both ends of the terminal group 60.
  • the narrowing amount W1B of the wiring 71 in the comparative example 1 is larger than the narrowing amount W1A of the wiring 71 in the present embodiment (see FIG. 5).
  • the amount of wiring narrowing referred to here is the length in the X-axis direction of the wiring arranged on the outermost side in the X-axis direction among the plurality of wirings extending in a fan shape toward one terminal group. is there. When the amount of narrowing down the wiring is large, a larger number of wirings are arranged in the Y-axis direction, so that the wiring arrangement space in the Y-axis direction becomes large.
  • reference numeral 71L is assigned to the leftmost wiring 71 out of the plurality of wirings 71 directed to one terminal group
  • reference numeral 71R is assigned to the rightmost wiring 71. It may be distinguished from other wiring 71.
  • the leftmost wiring 72 is denoted by reference numeral 72L
  • the rightmost wiring 72 is denoted by reference numeral 72R
  • the other wiring 72 is connected. It may be distinguished.
  • the narrowing amount W2B of the wiring 72L in the comparative example 1 is substantially the same as the narrowing amount W2A of the wiring 72L in the present embodiment, but the narrowing amount W2B1 of the wiring 72R in the comparative example 1 is the same as in the present embodiment. It is clearly larger than the narrowing amount W2A1 of the wiring 72R.
  • the amount of narrowing is larger for both the wiring 71 and the wiring 72 than in the present embodiment.
  • the frame dimension LB in the Y-axis direction is larger than the frame dimension LA in the Y-axis direction of the present embodiment, in principle for the wiring 71 and the wiring 72.
  • the second terminal group 2 ⁇ / b> C configured by a plurality of terminals 62
  • the first terminals configured by the plurality of terminals 61 on both sides in the X-axis direction in the second terminal group 2 ⁇ / b> C.
  • Groups 1CL and 1CR are arranged.
  • the plurality of terminals 61 and 62 are arranged at equal intervals.
  • half of the wires 71 are formed in a fan shape toward the first terminal group 1CL, and the other half of the wires 71 are fan-shaped toward the first terminal group 1CR. It is formed in the form narrowed down to.
  • the plurality of wirings 72 extend so as to be narrowed down toward the second terminal group 2 ⁇ / b> C, and have a fan-like appearance as a whole.
  • the narrowing amount W1C of the wiring 71L in the comparative example 2 is the same as the narrowing amount W1A of the wiring 71 in the present embodiment. Further, the narrowing amount W1C1 of the wiring 71R in the comparative example 2 is substantially the same as or slightly larger than the narrowing amount W1C.
  • the second terminal groups 2AL and 2AR are arranged on one end side and the other end side of the terminal group 60, respectively. On the other hand, in the second comparative example, the second terminal group 2C is arranged on the center side of the terminal group.
  • the narrowing amount W2C of the wiring 72L in the comparative example 2 is clearly larger than the narrowing amount W2A of the wiring 72L in the present embodiment.
  • the frame dimension LC in the Y-axis direction is larger than the frame dimension LA in the Y-axis direction of the present embodiment, as a rule for the wiring 72.
  • the first terminal group 1 ⁇ / b> D configured by a plurality of terminals 61 is arranged in an area having substantially the same length as the arrangement area of the RGB switch circuit 45 in the X-axis direction.
  • the plurality of terminals 61 are arranged at equal intervals at an arrangement pitch where one terminal 62 can be arranged.
  • a terminal 62 is disposed between adjacent terminals 61, and the plurality of terminals 62 constitute a second terminal group 2DL.
  • the terminal 62 In a location on the right side of the center of the first terminal group 1D, the terminal 62 is disposed between the adjacent terminals 61, and the plurality of terminals 62 constitute the second terminal group 2DR. In addition, since the total number of the terminals 62 is smaller than the total number of the terminals 61, the terminals 62 are not arranged between the adjacent terminals 61 in places other than the second terminal groups 2DL and 2DR.
  • the plurality of wirings 71 extend from the RGB switch circuit 45 toward the first terminal group 1D along the Y-axis direction.
  • one wiring 72 group is formed in a fan-shaped manner toward the second terminal group 2DL, and the other wiring 72 group is fan-shaped toward the second terminal group 2DR. It is formed in a narrowed form.
  • the frame dimension LD in the Y-axis direction is not affected.
  • the narrowing amount W2D of the wiring 72L in the comparative example 3 is substantially the same as the narrowing amount W2A of the wiring 72L in the present embodiment
  • the narrowing amount W2D1 of the wiring 72R in the comparative example 3 is the narrowing of the wiring 72R in the present embodiment. It is almost the same as the quantity W2A1.
  • the frame dimension LC in the Y-axis direction of Comparative Example 3 is substantially the same as the frame dimension LA in the Y-axis direction of the present embodiment.
  • the first terminal group 1D is arranged in an area having substantially the same length as the arrangement area of the RGB switch circuit 45 in the X-axis direction. For this reason, it is necessary to arrange the terminals 63 in the regions S3 on both sides of the first terminal group 1D. As a result, in the configuration of Comparative Example 3, the arrangement space in the X-axis direction related to the terminals 61, 62, and 63 is larger than in the configuration of the present embodiment, and it is difficult to narrow the frame of the active matrix substrate 22. Become.
  • the first terminal group 1E constituted by a plurality of terminals 61 is arranged in an area having substantially the same length as the arrangement area of the RGB switch circuit 45 in the X-axis direction.
  • the second terminal group 2EL, 2ER is the same as the comparative example 3 in that the second terminal group 2EL, 2ER is constituted by the terminals 62 arranged between the adjacent terminals 61, but from the second terminal groups 2DL, 2DR of the comparative example 3. Is different from the first terminal group 1E on the center side.
  • the plurality of wirings 71 extend from the RGB switch circuit 45 toward the first terminal group 1E along the Y-axis direction.
  • one wiring group 72 is formed so as to be narrowed toward the second terminal group 2EL, and the other wiring group 72 is narrowed toward the second terminal group 2ER. Is formed. That is, the plurality of wirings 72 are formed so as to be narrowed down in a fan shape toward the second terminal groups 2EL and 2ER.
  • the narrowing amount W2E of the wiring 72L in the comparative example 4 is larger than the narrowing amount W2A of the wiring 72L in the present embodiment.
  • the frame dimension LE in the Y-axis direction is larger than the frame dimension LA in the Y-axis direction of the present embodiment, as a rule for the wiring 72.
  • the terminals 63 need to be arranged in the regions S4 on both sides of the first terminal group 1E. For this reason, the arrangement space in the X-axis direction related to the terminals 61, 62, and 63 becomes larger than in the configuration of the present embodiment, making it difficult to narrow the active matrix substrate 22.
  • the first terminal group 1FC is arranged on the center side, and the first terminal groups 1FL, 1FR are arranged on both sides thereof.
  • the arrangement pitch of the terminals 61 of the first terminal group 1FC is set to twice the arrangement pitch of the terminals 61 of the first terminal groups 1FL and 1FR, and the second terminal is between the terminals 61 of the first terminal group 1FC.
  • a terminal 62 of group 2F is arranged.
  • the plurality of wirings 71 are formed in a fan-shaped manner from the RGB switch circuit 45 toward the first terminal groups 1FL, 1FC, 1FR.
  • the plurality of wirings 72 are formed in a fan-shaped manner toward the second terminal group 2F.
  • the narrowing amount W1F of the wiring 71L in the comparative example 5 is the same as the narrowing amount W1A of the wiring 71L in the present embodiment.
  • the terminal 62 arranged on the outermost side is arranged on the inner side of the first terminal groups 1FL and 1FR.
  • the terminals 62 arranged on the outermost side are respectively arranged near both ends of the terminal group 60.
  • the narrowing amount W2F of the wiring 72 (see the wiring 72L) in the comparative example 5 is larger than the narrowing amount W2A of the wiring 72 (see the wiring 72L) in the present embodiment.
  • the frame size LF in the Y-axis direction is larger than the frame size LA in the Y-axis direction of the present embodiment, as a rule for the wiring 72.
  • the configuration of the present embodiment can reduce the amount of narrowing of the wiring 71 and / or the wiring 72 as compared with the configurations of Comparative Examples 1, 2, and 5, and the frame in the Y-axis direction.
  • the dimension LA can be reduced.
  • the structure of this embodiment can make the frame size about an X-axis direction small with respect to the structure of Comparative Examples 3 and 4.
  • the outer dimensions of the glass substrate 26 can be further reduced. Thereby, the number of the glass substrates 26 which can be manufactured from one mother substrate can be increased, and manufacturing cost can be reduced.
  • the frame size of the liquid crystal panel 11 can be further reduced, it is possible to suppress a situation in which the degree of freedom in design of an electrical device using the liquid crystal panel 11 is impaired.
  • the driver 17 may be COF mounted on the flexible substrate 13.
  • the driver 17 is not directly stacked on the active matrix substrate 22, and the back surface of the active matrix substrate 22. Installed on the side. Therefore, a space for arranging the terminals may be secured at the peripheral end portion (non-display area A2) of the active matrix substrate 22. For this reason, the active matrix board
  • substrate 22 can be made still narrower frame combined with the effect which concerns on the arrangement
  • COF mounting it is not necessary to match the pitch of the terminals provided on the active matrix substrate 22 with the pitch of the output terminals of the driver 17, so that it depends on the specifications (screen size, etc.) of the active matrix substrate 22.
  • the terminal pitch can be set. For this reason, for example, a wider terminal pitch can be set.
  • COF mounting is a preferable configuration for narrowing the frame. Note that there is a concern that the driver 17 may be increased in size when a special configuration suitable for narrowing the frame, such as arranging terminals in an alternating manner, is used. In particular, in the case of COG mounting, there is a disadvantage that the frame of the active matrix substrate 22 becomes large because the enlarged driver 17 is placed. However, by adopting COF mounting, it is possible to avoid the frame of the active matrix substrate from being enlarged by the driver 17 even if the driver 17 is enlarged.
  • the terminal group 160 constituted by the terminals 61 and 62 is constituted by a center side terminal group 164 and end portion side terminal groups 165L and 165R.
  • 36 terminals 61 and 18 terminals 62 are illustrated as in the above embodiment.
  • the center side terminal group 164 is constituted by a plurality of terminals 61 arranged along the X-axis direction.
  • the end side terminal groups 165L and 165R are arranged in such a manner that a plurality of terminals 61 and a plurality of terminals 62 are mixed.
  • the end side terminal group 165L includes a first terminal group 1GL and three second terminal groups 2G1, 2G2, and 2G3.
  • the arrangement pitch of the terminals 61 in the first terminal group 1GL is larger than the arrangement pitch of the terminals 61 in the central terminal group 164, and the terminals 62 are arranged between the adjacent terminals 61.
  • two terminals 61 and 61 are continuously arranged, and the two terminals 61 and 61 are connected to the terminal 61 in the central terminal group 164. It has the same arrangement pitch as the arrangement pitch.
  • the arrangement pitch of the terminals 61 in the first terminal group 1GR is larger than the arrangement pitch of the terminals 61 in the center-side terminal group 164, and the terminals 62 are between the adjacent terminals 61. It is arranged. However, two terminals 61 are continuously arranged between the adjacent second terminal groups 2G4, 2G5, 2G6, and the two terminals 61, 61 are arranged pitches of the terminals 61 in the central terminal group 164. Have the same arrangement pitch. As described above, in the end-side terminal groups 165L and 165R of the present embodiment, a portion in which the terminal 62 is arranged between two adjacent terminals 61 and a portion in which two terminals 61 are continuously arranged are mixed. Has been.
  • the plurality of wirings 71 are drawn from the RGB switch circuit 45 toward the first terminal groups 1GL, 1GC, 1GR, and have a fan shape as a whole.
  • one wiring 72 is drawn out toward the second terminal groups 2G1, 2G2, and 2G3, and has a fan shape as a whole.
  • the other wiring 72 is drawn out toward the second terminal group 2G4, 2G5, 2G6 and has a fan shape as a whole.
  • the narrowing amount W1G of the wiring 71 is the same as the narrowing amount W1A of the wiring 71 in the first embodiment.
  • the narrowing amount W2G of the wiring 72L is the same as the narrowing amount W2A of the wiring 72L in the first embodiment.
  • the narrowing amount W2G1 of the wiring 72R is the narrowing amount of the wiring 72R in the first embodiment because the two terminals 61 and 61 are continuously arranged between the adjacent second terminal groups 2G1, 2G2, and 2G3.
  • the value is smaller than W2A1. Since the number of wirings 71 is larger than the number of wirings 72, the frame size LG in the Y-axis direction is easily affected.
  • the frame dimension LG is regulated by the wiring 71, and the narrowing amount W1G of the wiring 71 is the same as the narrowing amount W1A of the wiring 71 in the first embodiment. 1 is the same as the frame size LA in FIG.
  • each conductive film and each insulating film is not limited to the material illustrated by the said embodiment, It can change suitably.
  • the semiconductor film 33 of the TFT 43 is exemplified by using low-temperature polysilicon, but is not limited thereto. The material of the semiconductor film 33 can be changed as appropriate.
  • the semiconductor film 33 for example, amorphous silicon or an In—Ga—Zn—O based semiconductor may be used.
  • the configuration in which the plurality of terminals 61, 62, and 63 are arranged in a straight line along the X-axis direction is illustrated, but the present invention is not limited to this.
  • the plurality of terminals 61, 62, and 63 are only required to be arranged along the X-axis direction.
  • adjacent terminals in the X-axis direction are arranged (staggered) so as to be slightly shifted in the Y-axis direction. May be.
  • the configuration in which the plurality of wirings 72 are divided into two wiring groups and each wiring group forms a fan shape is illustrated, but the present invention is not limited to this.
  • the plurality of wirings 72 may be divided into three or more wiring groups, and each wiring group may have a fan shape.
  • (5) In the above embodiment, the configuration in which the terminal 61 and the source wiring 34A are connected via the RGB switch circuit 45 is illustrated, but the present invention is not limited to this. The configuration may be such that the RGB switch circuit 45 is not provided, and the source wiring 34A and the terminal 61 may be directly connected. That is, the same number of terminals 61 as the number of source wirings 34A may be provided.
  • the arrangement of the terminals 61 and 62 and the wirings 71 and 72 is symmetrical with respect to the Y axis. However, the present invention is not limited to this. For example, the pitch of the left half terminals and the pitch of the right half terminals in FIG. 5 may be different, and the wirings 71 and 72 may also be asymmetrical.
  • SYMBOLS 11 Liquid crystal panel (display panel), 21 ... CF substrate (counter substrate), 22 ... Active matrix substrate, 26 ... Glass substrate (substrate), 31G ... Gate electrode, 34S ... Source electrode, 40 ... Pixel electrode, 42 ... Common Electrode 43 ... TFT (switching element) 60 ... terminal group 61 ... terminal (first terminal) 62 ... terminal (second terminal) 63 ... terminal (third terminal) 64,164 ... center side terminal group , 65R, 65L, 165R, 165L ... end side terminal group, 71 ... wiring (wiring for switching element), 72 ... wiring (common electrode wiring), 3AL, 3AR ... third terminal group

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Abstract

ガラス基板２６と、マトリクス状に配列される複数の画素電極４０と、複数のＴＦＴ４３と、複数の共通電極４２と、ガラス基板２６上においてＹ軸方向の一端部に設けられ、Ｘ軸方向に沿って並ぶ複数の端子６１，６２によって構成される端子群６０と、端子６１とＴＦＴ４３とを電気的に接続する配線７１と、端子６２と共通電極４２とを電気的に接続する配線７２と、を備え、端子群６０は、端子群６０のＸ軸方向における中央部分を構成すると共に複数の端子６１によって構成される中央側端子群６４と、端子群６０のＸ軸方向における両側部分をそれぞれ構成すると共に複数の端子６１，６２によって構成されると共に、端子６２が隣り合う２つの端子６１の間に配されている端部側端子群６５Ｌ，６５Ｒと、を備えることに特徴を有する。

Description

アクティブマトリクス基板及び表示パネル
　本発明は、アクティブマトリクス基板及び表示パネルに関する。
　従来、携帯電話、スマートフォン、タブレット型ノートパソコンなどの携帯型の情報端末装置やコンピュータなどの電子機器には、液晶パネルなどの表示パネルを備えた表示装置が用いられている。表示パネルを構成するアクティブマトリクス基板においては、画素がマトリクス状に配列されており、各画素から引き出された配線の端子がアクティブマトリクス基板の一辺に沿って並んでいる。アクティブマトリクス基板に係る端子の配置態様については、例えば、下記特許文献１～５に記載されたものが知られている。
　特許文献１には、複数の端子において、配列方向の端部に配された端子間のピッチが、配列方向の中央部に配された端子間のピッチに比べて大きい構成が記載されている。特許文献２には、配列方向の端部に配された端子の面積及び端子間のピッチが、配列方向の中央部に配された端子の面積及び端子間のピッチに比べて大きい構成が記載されている。特許文献３には、ソースバスラインに係る端子、ゲートバスラインに係る端子、共通電極に係る端子がアクティブマトリクス基板の一辺に沿って配列されている構成が記載されている。また、特許文献３では、ソースバスラインに係る端子は３つの端子群に分けられており、ゲートバスラインに係る端子群がソースバスラインに係る端子群の外側に配されている。特許文献４には、ソースバスラインに係る端子とゲートバスラインに係る端子とが、アクティブマトリクス基板の一辺に形成されると共に、当該一辺方向において、交互に配されている構成が記載されている。
　ここで、特許文献１～４に記載されたアクティブマトリクス基板における端子の配置態様をまとめると以下（１）～（３）の通りである。
（１）複数の端子は、基本的には等間隔で配列され、同じ面積を有している。
（２）複数の端子の一部について、実装精度を高くするために配列ピッチを大きくしたり、低抵抗化のために面積を大きくしたりする場合がある。
（３）異なる機能を有する複数の端子が配列される場合は、機能毎に端子群としてグループ化され、一つの端子群の両側に他の端子群が配される場合がある。また、異なる機能を有する端子が基板の一辺方向において、交互に配列される場合がある。
　また、特許文献５には、タッチパネル機能を内蔵したインセル方式の液晶表示パネルが記載され、アクティブマトリクス基板の一辺にソースバスラインに係る端子、ゲートバスラインに係る端子、共通電極に係る端子が形成されている構成が記載されている。特許文献５に記載されているようなタッチパネル機能を内蔵したアクティブマトリクス基板においては、共通電極を分割構成することで、タッチ位置を検出することが可能となっている。
特開昭６１－３１２６号公報
特開２００５－９２１８５号公報
特開２００５－８４５３５号公報
特開平１１－３０５６８１号公報
特開２０１３－２５４１６８号公報
（発明が解決しようとする課題）
　上記表示装置については、近年、高解像度化及び狭額縁化が求められている。このため、端子の配置態様としては、表示装置の高解像度化に伴う端子数の増加に対応しつつ、狭額縁化を図ることが可能なものが求められる。特に特許文献５に記載されているようなタッチパネル機能を内蔵したアクティブマトリクス基板においては、画素から引き出された配線の端子に加えて、各共通電極から引き出された配線の端子を設ける必要がある。これにより、端子の総数が増加することから、狭額縁化を実現することがより困難となり、表示パネルの外形が大きくなってしまう。表示パネルの外形が大きくなると、例えば、意匠的な制約が生じることや、製造に係るコストが増加することが懸念される。
　本発明は上記のような事情に基づいて完成されたものであって、アクティブマトリクス基板の狭額縁化を図ることを目的とする。
（課題を解決するための手段）
　上記課題を解決するために、本発明のアクティブマトリクス基板は、基板と、前記基板上に設けられ、行方向及び列方向に沿ってマトリクス状に配列される複数の画素電極と、前記基板上に設けられ、前記複数の画素電極の各々に接続される複数のスイッチング素子と、前記基板上に設けられる複数の共通電極と、前記基板上において前記列方向の一端部に設けられ、前記行方向に沿って並ぶ複数の第１端子及び複数の第２端子によって構成される端子群であって、前記行方向における長さが、前記行方向における前記複数のスイッチング素子の配置領域の長さ及び前記行方向における前記複数の共通電極の配置領域の長さよりも小さい値で設定されている端子群と、前記基板上に設けられ、前記第１端子と前記列方向に並ぶ複数の前記スイッチング素子とを電気的に接続するスイッチング素子用配線であって、前記複数の第１端子の各々に対応して、複数本設けられるスイッチング素子用配線と、前記基板上に設けられ、前記複数の第２端子と前記複数の共通電極とをそれぞれ電気的に接続する複数の共通電極用配線と、を備え、前記端子群は、前記端子群の前記行方向における中央部分を構成する中央側端子群であって、前記行方向に沿って並ぶ複数の前記第１端子によって構成される中央側端子群と、前記端子群の前記行方向における両側部分をそれぞれ構成する端部側端子群であって、前記行方向に沿って並ぶ複数の前記第１端子及び前記行方向に沿って並ぶ複数の前記第２端子によって構成されると共に、前記第２端子が前記行方向において隣り合う２つの前記第１端子の間に配されている端部側端子群と、を備えることに特徴を有する。
　行方向に並ぶ複数の電極（又はスイッチング素子）の各々から、行方向における長さが相対的に小さい端子群の各端子に対して配線をそれぞれ延ばす場合には、複数の配線が端子群に向かって集束する形で配される。ここで、配線の集束の度合いが大きい程、配線の行方向における長さが大きくなるから、列方向において、より多くの配線が並ぶことになる。列方向に多くの配線が並ぶと、各配線の幅や隣り合う配線間の間隔に起因して、列方向における配線の配置スペースが大きくなってしまう。上記構成によれば、端子群の行方向における両側部分を構成する端部側端子群においては、隣り合う２つの第１端子の間に第２端子が配される構成とした。つまり、端部側端子群は、第１端子と第２端子とが混在する構成とした。これにより、仮に端子群の中央部分が第１端子のみによって構成され、端子群の両側部分が第２端子のみによって構成される場合に比べて、複数の第１端子の行方向における長さ、及び複数の第２端子の行方向における長さをより大きくすることができる。つまり、複数のスイッチング素子用配線の集束の度合い、及び複数の共通電極用配線の集束の度合いをそれぞれ小さくすることができる。この結果、スイッチング素子用配線及び共通電極用配線に係る列方向についての配置スペースをより小さくすることができるので、アクティブマトリクス基板の狭額縁化を図ることができる。
　また、前記基板上に設けられ、前記端子群に対して前記行方向における両側にそれぞれ配されると共に、前記行方向に沿って並ぶ複数の第３端子によって構成される第３端子群を備えるものとすることができる。上記構成では、端子群の行方向における長さが複数のスイッチング素子の配置領域の長さ及び複数の共通電極の配置領域の長さよりも小さい値で設定されている。このため、端子群の行方向における両側に端子を配置するスペースを確保することができる。このため、第１端子、第２端子以外の端子である第３端子を配した場合において、アクティブマトリクス基板が行方向に大きくなる事態を抑制できる。
　また、前記スイッチング素子用配線は、前記スイッチング素子のソース電極と電気的に接続されており、前記第３端子は、前記スイッチング素子のゲート電極と電気的に接続されているものとすることができる。このような構成とすれば、スイッチング素子及び共通電極に係る端子を行方向に沿って配列することができ、端子に係る列方向の配置スペースをより小さくすることができる。
　次に、上記課題を解決するために、本発明の表示パネルは、上記記載のアクティブマトリクス基板と、前記アクティブマトリクス基板に対して対向配置される対向基板と、を備える。このような構成の表示パネルによれば、アクティブマトリクス基板の狭額縁化が図られているので、表示パネルのデザイン性が高いものとなる。
（発明の効果）
　本発明によれば、アクティブマトリクス基板の狭額縁化を図ることができる。
本発明の実施形態１に係る液晶表示装置をＹ軸方向に沿う切断線で切断した断面図 液晶パネルを示す斜視図 表示領域におけるアクティブマトリクス基板を示す断面図 アクティブマトリクス基板を示す平面図 端子の配置態様を示す平面図 比較例１の端子の配置態様を示す平面図 比較例２の端子の配置態様を示す平面図 比較例３の端子の配置態様を示す平面図 比較例４の端子の配置態様を示す平面図 比較例５の端子の配置態様を示す平面図 実施形態２に係る端子の配置態様を示す平面図
　＜実施形態１＞
　本発明の実施形態１を図１から図１０によって説明する。なお、各図面の一部にはＸ軸、Ｙ軸及びＺ軸を示しており、各軸方向が各図面で示した方向となるように描かれている。液晶表示装置１０は、図１に示すように、液晶パネル１１（表示パネル）と、液晶パネル１１を駆動するドライバ１７（パネル駆動部）と、ドライバ１７に対して各種入力信号を外部から供給する制御回路基板１２（外部の信号供給源）と、液晶パネル１１と外部の制御回路基板１２とを電気的に接続するフレキシブル基板１３（外部接続部品）と、液晶パネル１１に光を供給する外部光源であるバックライト装置１４（照明装置）と、を備える。バックライト装置１４は、図１に示すように、表側（液晶パネル１１側）に向けて開口した略箱形をなすシャーシ１４Ａと、シャーシ１４Ａ内に配された図示しない光源（例えば冷陰極管、ＬＥＤ、有機ＥＬなど）と、シャーシ１４Ａの開口部を覆う形で配される図示しない光学部材と、を備える。光学部材は、光源から発せられる光を面状に変換するなどの機能を有するものである。
　また、液晶表示装置１０は、図１に示すように、相互に組み付けられた液晶パネル１１及びバックライト装置１４を収容及び保持するための表裏一対の外装部材１５，１６を備えており、このうち表側の外装部材１５には、液晶パネル１１の表示領域Ａ１に表示された画像を外部から視認させるための開口部１５Ａが形成されている。本実施形態に係る液晶表示装置１０は、例えば、携帯電話（スマートフォンなどを含む）、ノートパソコン（タブレット型ノートパソコンなどを含む）、ウェアラブル端末（スマートウォッチなどを含む）、携帯型情報端末（電子ブックやＰＤＡなどを含む）、携帯型ゲーム機、デジタルフォトフレームなどの各種電子機器（図示せず）に用いられるものである。
　液晶パネル１１は、図１に示すように、対向状に配される一対の基板２１，２２と、一対の基板２１，２２間に配され、電界印加に伴って光学特性が変化する物質である液晶分子を含む液晶層２３（媒質層）と、一対の基板２１，２２の間に配されると共に液晶層２３を囲むことで液晶層２３を封止するシール部材２４と、を備える。一対の基板２１，２２のうち表側（正面側、図１の上側）の基板がＣＦ基板２１（対向基板）とされ、裏側（背面側）の基板がアクティブマトリクス基板２２（アレイ基板、素子側基板）とされる。なお、液晶層２３に含まれる液晶分子は、例えば水平配向とされるが、これに限定されない。また、両基板２１，２２の外面側には、それぞれ図示しない偏光板が貼り付けられている。
　ＣＦ基板２１は、ガラス基板（図示せず）の内面側（液晶層２３側）に、カラーフィルタ、オーバーコート膜、配向膜（いずれも図示せず）が積層されることで構成されている。カラーフィルタは、マトリクス状に配列されるＲ（赤色），Ｇ（緑色），Ｂ（青色）の三色の着色部（図示せず）を備えている。各着色部は、アクティブマトリクス基板２２の各画素（図４参照）と対向配置されている。
　アクティブマトリクス基板２２は、図３に示すように、ガラス基板２６（基板）と、ガラス基板２６における内面側（液晶層２３側、図３の上側）に積層された各種の膜と、を備える。具体的には、ガラス基板２６上には、下層側から順にベースコート膜２８、半導体膜３３、ゲート絶縁膜３２、ゲート用導電膜３１、絶縁膜３５、導電膜３４、平坦化膜３６、配線７２、絶縁膜３９、画素電極４０、絶縁膜４１、共通電極４２が積層形成されている。ベースコート膜２８は、ガラス基板２６における表面の全体を覆うベタ状のパターンとされており、例えば酸化珪素（ＳｉＯ２）、窒化珪素（ＳｉＮｘ）、窒化酸化珪素（ＳｉＮＯ）などからなる。半導体膜３３は、ベースコート膜２８の上層に積層され、ＴＦＴ４３においてソース電極３４Ｓとドレイン電極３４Ｄとに接続されるチャネル部（半導体部）を構成する。半導体膜３３は、低温ポリシリコン（ＬＴＰＳ）からなる。
　ゲート絶縁膜３２は、ベースコート膜２８及び半導体膜３３の上層側に積層されている。ゲート用導電膜３１は、１種類の金属材料（例えばタンタルやタングステンなど）からなる単層膜や、異なる種類の金属材料からなる積層膜や、合金などによって構成され、導電性及び遮光性を有している。ゲート用導電膜３１は、ゲート配線３１Ａ（図４参照）やＴＦＴ４３のゲート電極３１Ｇなどを構成する。つまり、ゲート配線３１Ａとゲート電極３１Ｇは同じ層に配されている。絶縁膜３５は、ゲート絶縁膜３２及びゲート用導電膜３１の上層側に積層されている。導電膜３４は、絶縁膜３５の上層側に積層され、１種類の金属材料（例えばアルミニウム（Ａｌ）やクロム銅（Ｃｒ）など）からなる単層膜や、異なる種類の金属材料からなる積層膜や、合金などによって構成され、導電性及び遮光性を有している。導電膜３４は、ソース配線３４Ａ（図２参照）やＴＦＴ４３のソース電極３４Ｓ及びドレイン電極３４Ｄなどを構成する。つまり、導電膜３４は、ソース用導電膜及びドレイン用導電膜と呼ぶことができ、ソース配線３４Ａ、ソース電極３４Ｓ、ドレイン電極３４Ｄは同じ層に配されている。
　平坦化膜３６は、導電膜３４及び絶縁膜３５の上層側に積層されると共に、例えば有機樹脂材料であるアクリル系樹脂材料（例えばポリメタクリル酸メチル樹脂（ＰＭＭＡ））からなる。平坦化膜３６は有機絶縁膜であり、その膜厚が他の無機絶縁膜（絶縁膜３２，３５，３９，４１）に比べて厚いものとされ、表面を平坦化する機能を有する。配線７２は、例えば銅（Ｃｕ）、チタン（Ｔｉ）、モリブデン（Ｍｏ）、アルミニウム（Ａｌ）、マグネシウム（Ｍｇ）、コバルト（Ｃｏ）、クロム（Ｃｒ）、タングステン（Ｗ）のいずれか、またはこれらの混合物からなる。絶縁膜３９は、平坦化膜３６及び配線７２の上層側に積層されている。
　画素電極４０は、絶縁膜３９上に配されており、透明電極材料（例えばＩＴＯ（Indium Tin Oxide）など）の膜によって構成されている。絶縁膜４１は、画素電極４０及び絶縁膜３９の上層側に積層されている。共通電極４２は、絶縁膜４１上に配されており、透明電極材料（例えばＩＴＯなど）の膜によって構成されている。ゲート絶縁膜３２、絶縁膜３５、絶縁膜３９、絶縁膜４１は、例えば、窒化ケイ素（ＳｉＮｘ）、酸化ケイ素（ＳｉＯ２）等の無機材料からなる無機絶縁膜であり、防湿性を有している。
　また、表示領域Ａ１においては、スイッチング素子であるＴＦＴ４３が画素電極４０に対応して設けられている。ＴＦＴ４３は、ゲート電極３１Ｇと、半導体膜３３と、ソース電極３４Ｓと、ドレイン電極３４Ｄとを備える。平坦化膜３６、絶縁膜３９において、ドレイン電極３４Ｄと重なる箇所には、平坦化膜３６、絶縁膜３９を貫通する形でコンタクトホールＣＨ１が形成されている。画素電極４０は、コンタクトホールＣＨ１を介して、ドレイン電極３４Ｄと接続されている。絶縁膜３９，４１において、配線７２と重なる箇所には、絶縁膜３９，４１を貫通する形でコンタクトホールＣＨ２が形成されている。コンタクトホールＣＨ２は、液晶層２３側（図３の上側）に開口されており、共通電極４２は、コンタクトホールＣＨ２を介して、配線７２と接続されている。また、ゲート絶縁膜３２、絶縁膜３５を貫通する形でコンタクトホールＣＨ４，ＣＨ５がそれぞれ形成されている。ソース電極３４Ｓは、コンタクトホールＣＨ４を介して、半導体膜３３と接続されている。ドレイン電極３４Ｄは、コンタクトホールＣＨ５を介して、半導体膜３３と接続されている。
　液晶パネル１１は、図２に示すように、画像を表示可能な表示領域Ａ１と、表示領域Ａ１を取り囲む形で外周側に配される非表示領域Ａ２を有する。表示領域Ａ１は、ＣＦ基板２１とアクティブマトリクス基板２２とが重なる領域の内側部分に形成されている。ＣＦ基板２１及びアクティブマトリクス基板２２は、それぞれ方形状をなしており、アクティブマトリクス基板２２は、ＣＦ基板２１に対して、Ｙ軸方向における一方側に張り出している。これにより、アクティブマトリクス基板２２のＹ軸方向における一方側の周端部は、ＣＦ基板２１と重ならない領域となっており、この領域には、端子６１，６２，６３（詳しくは後述）が形成されている。端子６１，６２，６３には、例えば、ドライバ１７やフレキシブル基板１３などの回路部材が適宜接続される。なお、ドライバ１７はフレキシブル基板１３上に実装されていてもよく（ＣＯＦ実装）、その場合には、フレキシブル基板１３を介して各端子（主に端子６１，６２）がドライバ１７と接続される。
　図４に示すように、アクティブマトリクス基板２２を構成するガラス基板２６上において、表示領域Ａ１には、Ｘ軸方向（行方向）及びＹ軸方向（列方向）に沿ってマトリクス状に配列される複数の画素２７（画素アレイ）が設けられている。ガラス基板２６上において、Ｘ軸方向の両端部には、ゲートドライバ１８がそれぞれ設けられている。また、複数の画素２７の形成領域と、端子６１，６２，６３との間には、ＲＧＢスイッチ回路４５が設けられている。
　画素２７は、画素電極４０と、共通電極４２と、ＴＦＴ４３と、を備える。画素電極４０は、ガラス基板２６上に設けられ、Ｘ軸方向（ガラス基板２６の一辺方向）及びＹ軸方向（ガラス基板２６の他辺方向）に沿ってマトリクス状に複数配列されている。ＴＦＴ４３（薄膜トランジスタ、スイッチング素子）は、Ｘ軸方向及びＹ軸方向に沿ってマトリクス状に複数配列されている。ＴＦＴ４３は、ゲート配線３１Ａ及びソース配線３４Ａが交差する箇所に設けられており、複数のＴＦＴ４３が、複数の画素電極４０に対してそれぞれ接続されている。ＴＦＴ４３は、ゲート配線３１Ａ及びソース配線３４Ａにそれぞれ供給される各種信号に基づいて駆動され、その駆動に伴って画素電極４０に所定の電圧が印加されるようになっている。
　共通電極４２は、ベタ状の電極であり、複数本のスリット（図示せず）を有した画素電極４０と共通電極４２の間に電位差が生じると、共通電極４２と画素電極４０との間には、アクティブマトリクス基板２２の板面に沿う成分に加えて、アクティブマトリクス基板２２の板面に対する法線方向の成分を含むフリンジ電界（斜め電界）が生じる。これにより、そのフリンジ電界を利用して液晶層２３（図１参照）に含まれる液晶分子の配向状態を制御することで、表示領域Ａ１に画像を表示することができる。
　ゲートドライバ１８は、図４に示すように、Ｙ軸方向に長い形状をなしており、ガラス基板２６上にモノリシックに形成され、ＴＦＴ４３への出力信号の供給を制御するための制御回路を有している。Ｙ軸方向に沿って延びるゲート配線３１Ａは、両側のゲートドライバ１８にそれぞれ接続されている。また、ゲートドライバ１８からは、配線７３が複数本引き出されている。配線７３におけるゲートドライバ１８とは反対側の端部には、端子６３（第３端子）が設けられている。つまり、端子６３は、配線７３、ゲートドライバ１８及びゲート配線３１Ａを介してＴＦＴ４３のゲート電極３１Ｇと電気的に接続されている。ゲートドライバ１８には、端子６３及び配線７３を介して、例えば、制御回路基板１２（図１参照）から制御信号が供給される。
　なお、本実施形態ではゲートドライバ１８をガラス基板２６上のＸ軸方向における両端部にそれぞれ配置する構成を例示したが、これに限らない。例えばゲートドライバ１８をＸ軸方向における一端部のみに配置してもよい。また、Ｙ軸方向に並ぶゲート配線３１Ａのうち、偶数番目のゲート配線３１Ａを駆動するゲートドライバ１８をＸ軸方向における一方側に配し、奇数番目のゲート配線３１Ａを駆動するゲートドライバ１８をＸ軸方向における他方側に配してもよい。
　ＲＧＢスイッチ回路４５は、ゲートドライバ１８と同様にガラス基板２６上にモノリシックに形成されており、画素アレイの周囲の１辺（Ｘ軸方向）に沿う形で形成されている。赤色、緑色、青色の各画素２７に対応する３本のソース配線３４Ａは、ＲＧＢスイッチ回路４５を介して１本の配線７１と接続されている。配線７１（スイッチング素子用配線）におけるＲＧＢスイッチ回路４５とは反対側の端部には、端子６１（第１端子）が設けられている。配線７１は、ガラス基板２６上に設けられ、端子６１とＹ軸方向に並ぶ複数のＴＦＴ４３（ソース電極３４Ｓ）とを電気的に接続するための配線であり、複数の端子６１の各々に対応して、複数本設けられている。なお、ＲＧＢスイッチ回路４５から引き出された配線７１は、Ｙ軸方向に沿って端子６１側に延びた後、Ｙ軸に対して傾斜する方向に延び、その後、Ｙ軸方向に沿って端子６１に向かう形態で延びている。
　ＲＧＢスイッチ回路４５は、ドライバ１７側から供給される出力信号に含まれる画像信号を、各ソース配線３４Ａに振り分ける機能を有している。その結果各色の画素２７の透過率を変化させて、ＲＧＢの３原色方式のカラー表示を行うことができる。なお、本実施形態では、１本の配線７１を３本のソース配線３４Ａと接続する構成を例示したが、これに限らない。例えば１本の配線７１を２本のソース配線３４Ａに振り分けてもよいし、１本の配線７１を４本のソース配線３４Ａに振り分けてもよい。
　本実施形態に係る液晶パネル１１は、画像を表示する表示機能と、表示される画像に基づいて使用者が入力する位置（入力位置）を検出するタッチパネル機能（位置入力機能）と、を有しており、タッチパネル機能を発揮するためのタッチパネルパターンを一体化（インセル化）している。このタッチパネルパターンは、いわゆる投影型静電容量方式とされており、その検出方式が自己容量方式とされる。本実施形態では、タッチパネルパターンは、図２に示すように、ガラス基板２６上に設けられた複数の共通電極４２によって構成されている。つまり、共通電極４２は、位置検出電極の機能を有している。複数の共通電極４２は、Ｘ軸方向及びＹ軸方向に沿ってマトリクス状に配列されている。なお、共通電極４２の面積は、例えば、画素電極４０の面積よりも大きい値で設定されており、一つの共通電極４２が複数の画素電極４０に対して対向配置されている。なお、一つの共通電極４２の配置領域の一例を図４において符号Ａ３で示す。
　共通電極４２には、ガラス基板２６上に設けられた配線７２（共通電極用配線）の一端部が接続されている。配線７２の他端部には、端子６２が設けられている。つまり、配線７２は、複数の端子６２と複数の共通電極４２とをそれぞれ電気的に接続する構成とされる。共通電極４２には、端子６２及び配線７２を介して、共通電圧が印加される。
　また、液晶表示装置１０の使用者が、液晶パネル１１の表面（表示面）に導電体である指（位置入力体、図示せず）を近づけると、その指と共通電極４２との間で静電容量が形成されることになる。これにより、指の近くにある共通電極４２にて検出される静電容量は、指から遠くにある共通電極４２の静電容量とは異なるものとなるので、それに基づいて入力位置を検出することが可能となる。入力位置を検出する制御の際、制御回路基板１２は、ドライバ１７、端子６２及び配線７２を介して、入力位置を検出するための駆動信号を共通電極４２に供給すると共に、入力位置を検出するための検出信号を受信する。
　共通電極４２の配置数（分割数）は、タッチセンシングの分解能や表示画面の大小によって適宜設定される。例えば、５～６型程度のワイド画面の液晶パネルであれば５００から６００程度の分割数に設定される。なお、以下の説明では、共通電極４２の配置数をｎとして説明する。共通電極４２からから引き出された配線７２は、Ｙ軸方向に沿って端子６２側に延びた後、Ｙ軸に対して傾斜する方向に延び、その後、Ｙ軸方向に沿って端子６２に向かう形態で延びている。また、配線７２は、画素アレイとＺ軸方向（アクティブマトリクス基板２２の厚さ方向）において重なる形で配される。このため、配線７２は、図３に示すように、ゲート用導電膜３１及び導電膜３４（ソース用導電膜及びドレイン用導電膜）とは異なる導電膜によって形成され、異なる層（ゲート用導電膜３１及び導電膜３４に対して上層）に配される。
　次に、配線７１，７２，７３及び端子６１，６２，６３の構成について詳しく説明する。以下の説明では、端子６１によって構成される端子群を第１端子群と呼び、端子６２によって構成される端子群を第２端子群と呼ぶ。また、端子６３によって構成される端子群を第３端子群と呼ぶ。本実施形態では、図４に示すように、複数の端子６１，６２，６３がガラス基板２６上においてＹ軸方向の一端部に設けられ、Ｘ軸方向に沿って直線状に配列されている。複数の端子６１，６２によって構成される端子群を端子群６０とした場合、Ｘ軸方向において、端子群６０の長さは、複数のＴＦＴ４３の配置領域の長さ、複数の共通電極４２の配置領域の長さ、ＲＧＢスイッチ回路４５の配置領域の長さよりもそれぞれ小さい値で設定されている。このため、図５に示すように、複数の配線７１は、ＲＧＢスイッチ回路４５から端子６１によって構成される第１端子群（第１端子群１ＡＣ，１ＡＬ，１ＡＲ）に向かって扇状に絞り込まれるように形成されており、複数の配線７２は、複数の共通電極４２から第２端子群２ＡＬ，２ＡＲの各々に向かって扇状に絞り込まれるように形成されている。なお、端子６１，６２，６３の形状及び面積は、例えば同一とされる。なお、図５では、端子６３を図示省略している。
　端子群６０は、図４に示すように、Ｘ軸方向における中央部分を構成する中央側端子群６４と、Ｘ軸方向における両側部分をそれぞれ構成する端部側端子群６５Ｌ，６５Ｒと、を備える。中央側端子群６４は、Ｘ軸方向に沿って並ぶ複数の端子６１（第１端子群１ＡＣ）によって構成されている。端部側端子群６５Ｌ，６５Ｒは、端子６１及び端子６２によって構成されている。具体的には、端部側端子群６５Ｌは、Ｘ軸方向に沿って並ぶ複数の端子６１（第１端子群１ＡＬ）及び複数の端子６２（第２端子群２ＡＬ）によって構成されている。端部側端子群６５Ｒは、Ｘ軸方向に沿って並ぶ複数の端子６１（第１端子群１ＡＲ）及び複数の端子６２（第２端子群２ＡＲ）によって構成されている。端部側端子群６５Ｌ，６５Ｒは、中央側端子群６４をＸ軸方向における両側から挟む形で配されている。
　配線７１の本数は、画素２７の数と、ＲＧＢスイッチ回路４５によって１本の配線７１を何本のソース配線３４Ａに割り当てるかによって決定される。携帯電話に用いる液晶パネルにおいてポートレート表示の場合を例示すると、ＦＨＤ（１０８０×１９２０）の解像度では配線７１の本数は１０８０本とされ、ＷＱＨＤ（１４４０×２５６０）の解像度の場合では、配線７１の本数は１４４０本や２１６０本とされることが多い。以下の説明では、配線７１の本数をＮ本とする。つまり、端子６１の総数はＮ個となる。なお、配線７１は、例えば、ゲート用導電膜３１又は導電膜３４によって構成されている。
　図４に示すように、第１端子群１ＡＬは、第１端子群１ＡＣの左側に配され、第１端子群１ＡＲは、第１端子群１ＡＣの右側に配されている。第１端子群１ＡＣでは、複数の端子６１が配列ピッチｄ１で等間隔に配列されている。第１端子群１ＡＬ，１ＡＲでは、複数の端子６１が配列ピッチＤ１で等間隔に配列されている。配列ピッチＤ１は、例えば、配列ピッチｄ１の２倍で設定されている。また、第１端子群１ＡＣと第１端子群１ＡＬはＤ１のピッチで隣接し、第１端子群１ＡＣと第１端子群１ＡＲはｄ１又はＤ１のピッチで隣接されている。すなわち第１端子群１ＡＬ，１ＡＣ，１ＡＲは途中で配列ピッチが変わった総計Ｎ個の端子６１の配列とみなすことができる。
　配線７２及び端子６２の数は、それぞれ共通電極４２の数ｎと同数である。なお、上述したように一般的にＮは１０８０や１４４０や２１６０、ｎは５００～６００であるため、ｎ＜Ｎとなることが一般的である。端部側端子群６５Ｌ，６５Ｒでは、配列ピッチＤ１で隣り合う２つの端子６１の間に、端子６２が配されている。端部側端子群６５Ｌ，６５Ｒを構成する第２端子群２ＡＬ，２ＡＲでは、複数の端子６２が配列ピッチＤ２で等間隔に配列されている。配列ピッチＤ２は、配列ピッチＤ１と等しい値で設定されている。つまり、端部側端子群６５Ｌ，６５Ｒでは、端子６１と端子６２が交互に配列されている。なお、図５では、端子６１，６２の配置態様を分かり易くするために、端子６１，６２の個数を実際よりも少ない数で図示してあり、端子６１を３６個、端子６２を１８個として図示してある。
　図５に示すように、複数の配線７２のうち、一方の配線７２群（全配線７２の半数）は、第２端子群２ＡＬに向かって扇状に絞り込まれる形（集束する形）で形成されており、他方の配線７２群は、第２端子群２ＡＲに向かって扇状に絞り込まれる形で形成されている。なお、ガラス基板２６上において、配線７２は、配線７１と異なる層に配されており、配線７１と干渉する事態が防止されている。また、配線７２と配線７１とが重なる箇所においてのみ、配線７２が、配線７１と異なる層に配されていてもよい。また、配線７２は、ＲＧＢスイッチ回路４５とは異なる層に形成されており、平面視においてＲＧＢスイッチ回路４５と重なるように配されている。
　図４に示すように、複数の端子６３によって構成される第３端子群３ＡＬ，３ＡＲは、端子群６０に対して、Ｘ軸方向の両側にそれぞれ配されている。つまり、図４において、ガラス基板２６の１辺を左側から見ると、第３端子群３ＡＬ、端子群６０（端部側端子群６５Ｌ、中央側端子群６４，端部側端子群６５Ｒ）、第３端子群３ＡＲの順に配列されている。図４に示すように、Ｘ軸方向において、端子群６０の長さは、複数の画素２７によって構成される画素アレイの長さよりも小さくなっている。このため、第３端子群３ＡＬ，３ＡＲを端子群６０の両側に配した場合であっても、アクティブマトリクス基板２２のＸ軸方向における長さが大きくなる事態が抑制される。
　端子６３は画素２７のゲート配線３１Ａに係る端子としたが、その用途はこれに限定されない。例えば、端子６３を、図２に示すようにＲＧＢスイッチ回路４５の制御に係る配線７４のための端子としてもよい。また、端子６３の代わりに、液晶パネル１１の検査用の端子（図示せず）を配置したり、製品を製造管理する為のマークや製品名をパターニングしたものを設けたりしてもよい。また、ゲートドライバ１８に電源電力を供給するための端子として端子６３を用いる場合には、２つ以上の端子６３に跨って電源を電気的に接続してもよい。
　次に、本実施形態の効果について説明する。本実施形態のようにＸ軸方向に並ぶ複数の共通電極（又はスイッチング素子）の各々から、Ｘ軸方向における長さが相対的に小さい端子群の各端子に対して配線をそれぞれ延ばす場合には、複数の配線が端子群に向かって集束する形で配される。ここで、配線の集束の度合い（絞り込み量）が大きい程、配線のＸ軸方向における長さが大きくなるから、Ｙ軸方向において、より多くの配線が並ぶことになる。Ｙ軸方向に多くの配線が並ぶと、各配線の幅や隣り合う配線間の間隔に起因して、Ｙ軸方向における配線の配置スペースが大きくなってしまう。
　本実施形態では、図５に示すように、端子群６０のＸ軸方向における両側部分を構成する端部側端子群６５Ｌ，６５Ｒにおいては、隣り合う２つの端子６１の間に端子６２が配される構成とした。つまり、端部側端子群６５Ｌ，６５Ｒは、端子６１と端子６２とが混在する構成とした。これにより、仮に端子群６０の中央部分が複数の端子６１のみによって構成され、端子群の両側部分が複数の端子６２のみによって構成される場合（図６の端子群参照、詳しくは後述）に比べて、複数の端子６１のＸ軸方向における長さ（第１端子群１ＡＬ，１ＡＣ，１ＡＲを合わせた長さ）、及び複数の端子６２のＸ軸方向における長さ（第２端子群２ＡＬ，２ＡＲの各長さ）をより大きくすることができる。つまり、複数の配線７１の集束の度合い（図５の絞り込み量Ｗ１Ａ）、及び複数の配線７２の集束の度合い（図５の絞り込み量Ｗ２Ａ，Ｗ２Ａ１）をそれぞれ小さくすることができる。この結果、配線７１及び配線７２に係るＹ軸方向についての配置スペース（Ｙ軸方向についての額縁寸法ＬＡ）をより小さくすることができるので、アクティブマトリクス基板２２の狭額縁化を図ることができる。
　また、図４に示すように、ガラス基板２６上に設けられ、端子群６０に対してＸ軸方向における両側にそれぞれ配されると共に、Ｘ軸方向に沿って並ぶ複数の端子６３によって構成される第３端子群３ＡＬ，３ＡＲを備える。本実施形態では、端子群６０のＸ軸方向における長さが複数のＴＦＴ４３の配置領域の長さ及び複数の共通電極４２の配置領域の長さよりも小さい値で設定されている。このため、端子群６０のＸ軸方向における両側に端子を配置するスペースを確保することができる。このため、端子６１、端子６２以外の端子である端子６３を配した場合において、アクティブマトリクス基板２２がＸ軸方向に大きくなる事態を抑制できる。
　また、配線７１は、ＴＦＴ４３のソース電極３４Ｓと電気的に接続されており、端子６３は、ＴＦＴ４３のゲート電極３１Ｇと電気的に接続されている。このような構成とすれば、ＴＦＴ４３及び共通電極４２に係る端子６１，６２，６３をＸ軸方向に沿って配列することができ、端子６１，６２，６３に係るＹ軸方向の配置スペースをより小さくすることができる。
　次に、本実施形態の効果について比較例１～５を例示して詳しく説明する。比較例１～５は、端子６１，６２の配置態様が本実施形態と相違しており、それ以外の構成は、本実施形態と同じである。なお、比較例１～５では、端子６１の総数及び端子６２の総数については、本実施形態と同数である。また、比較例１～５を示す図６～図１０においては、端子６３を図示省略している。図６に示す比較例１では、複数の端子６１によって構成された第１端子群１Ｂが設けられ、第１端子群１ＢにおけるＸ軸方向の両側に、複数の端子６２によって構成された第２端子群２ＢＬ，２ＢＲがそれぞれ配されている。複数の端子６１，６２は等間隔で配列されている。複数の配線７１は、ＲＧＢスイッチ回路４５から第１端子群１Ｂへ向かって絞り込まれる形で延びており、全体としては扇状の外観を呈する。複数の配線７２のうち、一方の配線７２群は、第２端子群２ＢＬに向かって扇状に絞り込まれる形で形成されており、他方の配線７２群は、第２端子群２ＢＲに向かって扇状に絞り込まれる形で形成されている。
　Ｘ軸方向において、第１端子群１Ｂの長さは、本実施形態の第１端子群の長さ（第１端子群１ＡＬ，１ＡＣ，１ＡＲを合わせた長さ）よりも小さくなっている。言い換えると、本実施形態では、端子６１が、端子群６０の両端に配されている。このため、比較例１における配線７１の絞り込み量Ｗ１Ｂは、本実施形態における配線７１の絞り込み量Ｗ１Ａ（図５参照）と比べて大きくなっている。ここで言う配線の絞り込み量とは、１つの端子群に向かって扇状をなす形で延びる複数の配線のうち、Ｘ軸方向において最も外側に配される配線のＸ軸方向の長さのことである。配線の絞り込み量が大きいということは、Ｙ軸方向について、より多くの本数の配線が並ぶことになるから、Ｙ軸方向における配線の配置スペースが大きくなる。
　なお、以下の説明では、一つの端子群に向かう複数の配線７１のうち、最も左側に配された配線７１に符号７１Ｌを付し、最も右側に配された配線７１に符号７１Ｒを付して他の配線７１と区別する場合がある。また、一つの端子群に向かう複数の配線７２のうち、最も左側に配された配線７２に符号７２Ｌを付し、最も右側に配された配線７２に符号７２Ｒを付して他の配線７２と区別する場合がある。
　Ｘ軸方向において、第２端子群２ＢＬの長さは、本実施形態の第２端子群２ＡＬの長さよりも小さくなっている。このため、比較例１における配線７２Ｌの絞り込み量Ｗ２Ｂは、本実施形態における配線７２Ｌの絞り込み量Ｗ２Ａとほぼ同一となっているが、比較例１における配線７２Ｒの絞り込み量Ｗ２Ｂ１は、本実施形態における配線７２Ｒの絞り込み量Ｗ２Ａ１と比べて明らかに大きくなっている。このように、比較例１は、配線７１及び配線７２の双方について、本実施形態よりも絞り込み量が大きくなっている。つまり、比較例１は、配線７１及び配線７２に律則して、Ｙ軸方向についての額縁寸法ＬＢが、本実施形態のＹ軸方向についての額縁寸法ＬＡよりも大きくなっている。
　図７に示す比較例２では、複数の端子６２によって構成された第２端子群２Ｃが設けられ、第２端子群２ＣにおけるＸ軸方向の両側に、複数の端子６１によって構成された第１端子群１ＣＬ，１ＣＲがそれぞれ配されている。複数の端子６１，６２は、等間隔で配列されている。複数の配線７１のうち、半数の配線７１群は、第１端子群１ＣＬに向かって扇状に絞り込まれる形で形成されており、残り半数の配線７１群は、第１端子群１ＣＲに向かって扇状に絞り込まれる形で形成されている。複数の配線７２は、第２端子群２Ｃへ向かって絞り込まれる形で延びており、全体としては扇状の外観を呈する。
　比較例２における配線７１Ｌの絞り込み量Ｗ１Ｃは、本実施形態における配線７１の絞り込み量Ｗ１Ａと同一である。また、比較例２における配線７１Ｒの絞り込み量Ｗ１Ｃ１は、絞り込み量Ｗ１Ｃとほぼ同じ又は若干大きい値となる。また、本実施形態では、第２端子群２ＡＬ，２ＡＲが、端子群６０の一端側及び他端側にそれぞれ配されている。これに対して、比較例２では、端子群の中央側に第２端子群２Ｃが配されている。このため、比較例２における配線７２Ｌの絞り込み量Ｗ２Ｃは、本実施形態における配線７２Ｌの絞り込み量Ｗ２Ａと比べて明らかに大きくなっている。この結果、比較例２は、配線７２に律則して、Ｙ軸方向についての額縁寸法ＬＣが、本実施形態のＹ軸方向についての額縁寸法ＬＡよりも大きくなっている。
　図８に示す比較例３では、複数の端子６１によって構成された第１端子群１Ｄが、Ｘ軸方向においてＲＧＢスイッチ回路４５の配置領域とほぼ同じ長さの領域に配されている。複数の端子６１は、一つの端子６２を配することが可能な配列ピッチで等間隔に配列されている。第１端子群１Ｄにおける中央よりも左側の箇所では、隣り合う端子６１の間に端子６２が配されており、複数の端子６２によって第２端子群２ＤＬが構成されている。第１端子群１Ｄにおける中央よりも右側の箇所では、隣り合う端子６１の間に端子６２が配されており、複数の端子６２によって第２端子群２ＤＲが構成されている。なお、端子６２の総数は、端子６１の総数よりも少ないため、第２端子群２ＤＬ，２ＤＲ以外の箇所では、隣り合う端子６１の間に端子６２が配されていない。複数の配線７１は、ＲＧＢスイッチ回路４５からＹ軸方向に沿う形で第１端子群１Ｄに向かって延びている。複数の配線７２のうち、一方の配線７２群は、第２端子群２ＤＬに向かって扇状に絞り込まれる形で形成されており、他方の配線７２群は、第２端子群２ＤＲに向かって扇状に絞り込まれる形で形成されている。
　比較例３では、配線７１がＹ軸方向に沿って延びることから、Ｙ軸方向についての額縁寸法ＬＤに影響を与えることはない。また、比較例３における配線７２Ｌの絞り込み量Ｗ２Ｄは、本実施形態における配線７２Ｌの絞り込み量Ｗ２Ａとほぼ同一であり、比較例３における配線７２Ｒの絞り込み量Ｗ２Ｄ１は、本実施形態における配線７２Ｒの絞り込み量Ｗ２Ａ１とほぼ同一である。このため、比較例３のＹ軸方向についての額縁寸法ＬＣは、本実施形態のＹ軸方向についての額縁寸法ＬＡとほぼ同じとなっている。しかしながら、比較例３では、第１端子群１Ｄが、Ｘ軸方向においてＲＧＢスイッチ回路４５の配置領域とほぼ同じ長さの領域に配されている。このため、端子６３については、第１端子群１Ｄの両側の領域Ｓ３に配置する必要がある。この結果、比較例３の構成では、本実施形態の構成に比べて端子６１，６２，６３に係るＸ軸方向の配置スペースがより大きくなってしまい、アクティブマトリクス基板２２の狭額縁化が困難となる。
　図９に示す比較例４では、複数の端子６１によって構成された第１端子群１Ｅが、Ｘ軸方向においてＲＧＢスイッチ回路４５の配置領域とほぼ同じ長さの領域に配されている。第２端子群２ＥＬ，２ＥＲは、隣り合う端子６１間に配された端子６２によって構成されている点は、上記比較例３と同様であるが、比較例３の第２端子群２ＤＬ，２ＤＲよりも、第１端子群１Ｅの中央側に配されている点が相違する。
　比較例４では、複数の配線７１は、ＲＧＢスイッチ回路４５からＹ軸方向に沿う形で第１端子群１Ｅに向かって延びている。複数の配線７２のうち、一方の配線７２群は、第２端子群２ＥＬに向かって絞り込まれる形で形成されており、他方の配線７２群は、第２端子群２ＥＲに向かって絞り込まれる形で形成されている。つまり、複数の配線７２は、第２端子群２ＥＬ，２ＥＲに向かって扇状に絞り込まれる形で形成されている。比較例４における配線７２Ｌの絞り込み量Ｗ２Ｅは、本実施形態における配線７２Ｌの絞り込み量Ｗ２Ａよりも大きくなっている。つまり、比較例４は、配線７２に律則して、Ｙ軸方向についての額縁寸法ＬＥが、本実施形態のＹ軸方向についての額縁寸法ＬＡよりも大きくなっている。また、比較例４の構成では、比較例３の構成と同様に、端子６３については、第１端子群１Ｅの両側の領域Ｓ４に配置する必要がある。このため、本実施形態の構成に比べて端子６１，６２，６３に係るＸ軸方向の配置スペースがより大きくなってしまい、アクティブマトリクス基板２２の狭額縁化が困難となる。
　図１０に示す比較例５では、第１端子群１ＦＣが中央側に、第１端子群１ＦＬ，１ＦＲがその両側にそれぞれ配されている。第１端子群１ＦＣの端子６１の配列ピッチは、第１端子群１ＦＬ，１ＦＲの端子６１の配列ピッチの２倍で設定されており、第１端子群１ＦＣの端子６１間には、第２端子群２Ｆの端子６２が配されている。複数の配線７１は、ＲＧＢスイッチ回路４５から第１端子群１ＦＬ，１ＦＣ，１ＦＲに向かって扇状に絞り込まれる形で形成されている。複数の配線７２は、第２端子群２Ｆに向かって扇状に絞り込まれる形で形成されている。
　比較例５における配線７１Ｌの絞り込み量Ｗ１Ｆは、本実施形態における配線７１Ｌの絞り込み量Ｗ１Ａと同じとなっている。また、比較例５では、最も外側に配される端子６２が、第１端子群１ＦＬ，１ＦＲの内側に配されている。これに対して、本実施形態では、最も外側に配される端子６２が端子群６０の両端付近にそれぞれ配されている。このため、比較例５における配線７２（配線７２Ｌ参照）の絞り込み量Ｗ２Ｆは、本実施形態における配線７２（配線７２Ｌ参照）の絞り込み量Ｗ２Ａよりも大きくなっている。このため、比較例５は、配線７２に律則して、Ｙ軸方向についての額縁寸法ＬＦが、本実施形態のＹ軸方向についての額縁寸法ＬＡよりも大きくなっている。
　以上説明したように、本実施形態の構成は、比較例１，２，５の構成に対して、配線７１又は／及び配線７２の絞り込み量をより小さくすることができ、Ｙ軸方向についての額縁寸法ＬＡを小さくすることができる。また、本実施形態の構成は、比較例３，４の構成に対して、Ｘ軸方向についての額縁寸法を小さくすることができる。
　このように、本実施形態によれば、ガラス基板２６の外形寸法をより小さくすることができる。これにより、１枚のマザー基板から製造できるガラス基板２６の枚数を増やすことができ、製造コストを低減することができる。また、液晶パネル１１の額縁寸法をより小さくすることができるから、液晶パネル１１を用いた電気機器のデザインの自由度が損なわれる事態を抑制することができる。
　なお、本実施形態では、ドライバ１７がフレキシブル基板１３上にＣＯＦ実装されていてもよく、ＣＯＦ実装とした場合は、ドライバ１７はアクティブマトリクス基板２２には直接積載されず、アクティブマトリクス基板２２の背面側に設置される。したがってアクティブマトリクス基板２２の周端部（非表示領域Ａ２）には、端子を配置するためのスペースを確保すればよい。このため、上述した端子７１，７２，７３の配置態様に係る効果と相まってアクティブマトリクス基板２２をより一層狭額縁化させることができる。またＣＯＦ実装とした場合には、アクティブマトリクス基板２２に設けられた端子のピッチをドライバ１７の出力端子のピッチと一致させる必要がないから、アクティブマトリクス基板２２の仕様（画面サイズ等）に応じて、端子ピッチを設定することができる。このため、例えば、より広い端子ピッチに設定することができる。この点においてもＣＯＦ実装は狭額縁化に好ましい構成である。なお端子の並びを交互配置するなど狭額縁化に適した特殊な構成とした場合はドライバ１７が大型化する可能性が懸念される。特にＣＯＧ実装の場合においては、大型化したドライバ１７を載置するためにアクティブマトリクス基板２２の額縁が大きくなってしまう不都合が生じる。しかしＣＯＦ実装とすることによって、たとえドライバ１７が大型化しても、ドライバ１７によってアクティブマトリクス基板の額縁が大きくなってしまうことを避けることができる。
　＜実施形態２＞
　次に、本発明の実施形態２を図１１によって説明する。本実施形態では、端子６１，６２の配置態様が上記実施形態１と相違する。なお、上記実施形態と同一部分には、同一符号を付して重複する説明を省略する。本実施形態では、端子６１，６２によって構成される端子群１６０は、中央側端子群１６４及び端部側端子群１６５Ｌ，１６５Ｒによって構成されている。本実施形態では、上記実施形態と同様に端子６１を３６個、端子６２を１８個として図示してある。中央側端子群１６４は、Ｘ軸方向に沿って並ぶ複数の端子６１によって構成されている。端部側端子群１６５Ｌ，１６５Ｒは、それぞれ、複数の端子６１及び複数の端子６２が混在する形で配されている。
　端部側端子群１６５Ｌは、第１端子群１ＧＬ及び３つの第２端子群２Ｇ１，２Ｇ２，２Ｇ３によって構成されている。第１端子群１ＧＬにおける端子６１の配列ピッチは、中央側端子群１６４における端子６１の配列ピッチに比べて大きいものとされ、隣り合う端子６１の間に端子６２が配されている。但し、隣り合う第２端子群２Ｇ１，２Ｇ２，２Ｇ３間には、２つの端子６１，６１が連続して配されており、その２つの端子６１，６１は、中央側端子群１６４における端子６１の配列ピッチと同じ配列ピッチを有している。端部側端子群１６５Ｒでは、第１端子群１ＧＲにおける端子６１の配列ピッチは、中央側端子群１６４における端子６１の配列ピッチに比べて大きいものとされ、隣り合う端子６１の間に端子６２が配されている。但し、隣り合う第２端子群２Ｇ４，２Ｇ５，２Ｇ６間には、２つの端子６１が連続して配されており、その２つの端子６１，６１は、中央側端子群１６４における端子６１の配列ピッチと同じ配列ピッチを有している。このように、本実施形態の端部側端子群１６５Ｌ，１６５Ｒでは、隣り合う２つの端子６１の間に端子６２が配されている部分と、端子６１が連続して２つ並ぶ部分とが混在されている。
　複数の配線７１は、ＲＧＢスイッチ回路４５から第１端子群１ＧＬ、１ＧＣ、１ＧＲに向かって引き出されており、全体として扇状をなしている。複数の配線７２のうち、一方の配線７２は、第２端子群２Ｇ１，２Ｇ２，２Ｇ３に向かって引き出され、全体として扇状をなしている。複数の配線７２のうち、他方の配線７２は、第２端子群２Ｇ４，２Ｇ５，２Ｇ６に向かって引き出され、全体として扇状をなしている。配線７１の絞り込み量Ｗ１Ｇは、実施形態１における配線７１の絞り込み量Ｗ１Ａと同一である。配線７２Ｌの絞り込み量Ｗ２Ｇは、実施形態１における配線７２Ｌの絞り込み量Ｗ２Ａと同一である。隣り合う第２端子群２Ｇ１，２Ｇ２，２Ｇ３間に２つの端子６１，６１が連続して配されていることに起因して、配線７２Ｒの絞り込み量Ｗ２Ｇ１は、実施形態１における配線７２Ｒの絞り込み量Ｗ２Ａ１よりも小さい値となっている。なお、配線７１の本数は、配線７２の本数よりも多いことから、Ｙ軸方向についての額縁寸法ＬＧにより影響を与えやすい。本実施形態では、額縁寸法ＬＧが配線７１によって律則されており、配線７１の絞り込み量Ｗ１Ｇは、実施形態１における配線７１の絞り込み量Ｗ１Ａと同一であることから、額縁寸法ＬＧは、実施形態１における額縁寸法ＬＡと同じとなっている。
　＜他の実施形態＞
　本発明は上記記述及び図面によって説明した実施形態に限定されるものではなく、例えば次のような実施形態も本発明の技術的範囲に含まれる。
　（１）各導電膜及び各絶縁膜の材質は、上記実施形態で例示した材質に限定されず、適宜変更可能である。
　（２）上記実施形態では、ＴＦＴ４３の半導体膜３３として、低温ポリシリコンを用いたものを例示したが、これに限定されない。半導体膜３３の材質は適宜変更可能であり、半導体膜３３として、例えば、アモルファスシリコンやＩｎ－Ｇａ－Ｚｎ－Ｏ系半導体を用いてもよい。
　（３）上記実施形態では、複数の端子６１，６２，６３がＸ軸方向に沿って直線状に並ぶ構成を例示したが、これに限定されない。複数の端子６１，６２，６３は、それぞれＸ軸方向に沿って並ぶものであればよく、例えば、Ｘ軸方向について隣り合う端子がＹ軸方向についてわずかにずれる形で配列（千鳥配列）されていてもよい。
　（４）上記実施形態では、複数の配線７２を２つの配線群に分け、各配線群がそれぞれ扇状をなす構成を例示したが、これに限定されない。複数の配線７２を３つ以上の配線群に分け、各配線群がそれぞれ扇状をなす構成としてもよい。
　（５）上記実施形態では、ＲＧＢスイッチ回路４５を介して、端子６１とソース配線３４Ａが接続されている構成を例示したが、これに限定されない。ＲＧＢスイッチ回路４５を備えていない構成であってもよく、ソース配線３４Ａと端子６１とが直接的に接続されていてもよい。つまり、端子６１がソース配線３４Ａの本数と同数設けられていてもよい。
　（６）上記実施形態では、端子６１，６２及び配線７１，７２の配置がＹ軸を基準として左右対称となるような形態としたが、これに限定されない。例えば、図５の左半分の端子のピッチと右半分の端子のピッチが異なっていてもよく、配線７１，７２についても左右非対称をなす配置としてもよい。
１１…液晶パネル（表示パネル）、２１…ＣＦ基板（対向基板）、２２…アクティブマトリクス基板、２６…ガラス基板（基板）、３１Ｇ…ゲート電極、３４Ｓ…ソース電極、４０…画素電極、４２…共通電極、４３…ＴＦＴ（スイッチング素子）、６０…端子群、６１…端子（第１端子）、６２…端子（第２端子）、６３…端子（第３端子）、６４，１６４…中央側端子群、６５Ｒ，６５Ｌ，１６５Ｒ，１６５Ｌ…端部側端子群、７１…配線（スイッチング素子用配線）、７２…配線（共通電極用配線）、３ＡＬ，３ＡＲ…第３端子群

Claims (4)

  1. 　基板と、
    　前記基板上に設けられ、行方向及び列方向に沿ってマトリクス状に配列される複数の画素電極と、
    　前記基板上に設けられ、前記複数の画素電極の各々に接続される複数のスイッチング素子と、
    　前記基板上に設けられる複数の共通電極と、
    　前記基板上において前記列方向の一端部に設けられ、前記行方向に沿って並ぶ複数の第１端子及び複数の第２端子によって構成される端子群であって、前記行方向における長さが、前記行方向における前記複数のスイッチング素子の配置領域の長さ及び前記行方向における前記複数の共通電極の配置領域の長さよりも小さい値で設定されている端子群と、
    　前記基板上に設けられ、前記第１端子と前記列方向に並ぶ複数の前記スイッチング素子とを電気的に接続するスイッチング素子用配線であって、前記複数の第１端子の各々に対応して、複数本設けられるスイッチング素子用配線と、
    　前記基板上に設けられ、前記複数の第２端子と前記複数の共通電極とをそれぞれ電気的に接続する複数の共通電極用配線と、を備え、
    　前記端子群は、
    　前記端子群の前記行方向における中央部分を構成する中央側端子群であって、前記行方向に沿って並ぶ複数の前記第１端子によって構成される中央側端子群と、
    　前記端子群の前記行方向における両側部分をそれぞれ構成する端部側端子群であって、前記行方向に沿って並ぶ複数の前記第１端子及び前記行方向に沿って並ぶ複数の前記第２端子によって構成されると共に、前記第２端子が前記行方向において隣り合う２つの前記第１端子の間に配されている端部側端子群と、を備えるアクティブマトリクス基板。
  2. 　前記基板上に設けられ、前記端子群に対して前記行方向における両側にそれぞれ配されると共に、前記行方向に沿って並ぶ複数の第３端子によって構成される第３端子群を備える請求項１に記載のアクティブマトリクス基板。
  3. 　前記スイッチング素子用配線は、前記スイッチング素子のソース電極と電気的に接続されており、
    　前記第３端子は、前記スイッチング素子のゲート電極と電気的に接続されている請求項２に記載のアクティブマトリクス基板。
  4. 　請求項１から請求項３のいずれか１項に記載のアクティブマトリクス基板と、前記アクティブマトリクス基板に対して対向配置される対向基板と、を備える表示パネル。
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Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US11256308B2 (en) * 2019-03-14 2022-02-22 Sharp Kabushiki Kaisha Wiring substrate and display panel

Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002049032A (ja) * 2000-05-25 2002-02-15 Seiko Epson Corp 液晶装置、その製造方法および電子機器
JP2006023764A (ja) * 2003-02-20 2006-01-26 Seiko Epson Corp 電気光学装置
JP2007094024A (ja) * 2005-09-29 2007-04-12 Sanyo Epson Imaging Devices Corp 液晶表示装置
WO2013011678A1 (ja) * 2011-07-20 2013-01-24 シャープ株式会社 アクティブマトリクス基板及びそれを備えた表示パネル
JP2013122752A (ja) * 2011-12-09 2013-06-20 Lg Display Co Ltd タッチスクリーン一体型表示装置
JP2016129001A (ja) * 2015-01-09 2016-07-14 株式会社ジャパンディスプレイ 液晶表示装置
WO2017033759A1 (ja) * 2015-08-21 2017-03-02 シャープ株式会社 表示装置

Family Cites Families (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0640181B2 (ja) 1984-06-15 1994-05-25 シチズン時計株式会社 液晶表示装置
JPH11305681A (ja) 1998-04-17 1999-11-05 Casio Comput Co Ltd 表示装置
JP4111174B2 (ja) 2003-08-08 2008-07-02 セイコーエプソン株式会社 電気光学パネル、電気光学装置及び電子機器
JP2005084535A (ja) 2003-09-10 2005-03-31 Sharp Corp 表示装置
KR101300683B1 (ko) * 2006-02-06 2013-08-26 삼성디스플레이 주식회사 액정 표시 장치
WO2011027589A1 (ja) * 2009-09-02 2011-03-10 シャープ株式会社 デバイス基板
KR101705357B1 (ko) * 2009-12-21 2017-02-10 엘지디스플레이 주식회사 정전용량 방식 터치 센서 내장형 표시장치
JP6032794B2 (ja) 2012-06-08 2016-11-30 株式会社ジャパンディスプレイ 液晶表示装置
CN203519982U (zh) * 2013-08-23 2014-04-02 北京京东方光电科技有限公司 一种交替布线的接触端子对
JP2015227991A (ja) * 2014-06-02 2015-12-17 株式会社ジャパンディスプレイ 立体画像表示装置
KR102416467B1 (ko) * 2015-07-30 2022-07-04 엘지디스플레이 주식회사 터치 스크린 패널 및 표시 장치
US10262590B2 (en) * 2015-08-03 2019-04-16 Sharp Kabushiki Kaisha Active matrix substrate and display panel
CN105427748B (zh) * 2016-01-04 2018-10-09 京东方科技集团股份有限公司 一种阵列基板、显示面板、显示装置及显示方法

Patent Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002049032A (ja) * 2000-05-25 2002-02-15 Seiko Epson Corp 液晶装置、その製造方法および電子機器
JP2006023764A (ja) * 2003-02-20 2006-01-26 Seiko Epson Corp 電気光学装置
JP2007094024A (ja) * 2005-09-29 2007-04-12 Sanyo Epson Imaging Devices Corp 液晶表示装置
WO2013011678A1 (ja) * 2011-07-20 2013-01-24 シャープ株式会社 アクティブマトリクス基板及びそれを備えた表示パネル
JP2013122752A (ja) * 2011-12-09 2013-06-20 Lg Display Co Ltd タッチスクリーン一体型表示装置
JP2016129001A (ja) * 2015-01-09 2016-07-14 株式会社ジャパンディスプレイ 液晶表示装置
WO2017033759A1 (ja) * 2015-08-21 2017-03-02 シャープ株式会社 表示装置

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