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WO1993010588A1 - Reverse-supply protection device for power output stage transistors - Google Patents

Reverse-supply protection device for power output stage transistors Download PDF

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WO1993010588A1
WO1993010588A1 PCT/DE1992/000929 DE9200929W WO9310588A1 WO 1993010588 A1 WO1993010588 A1 WO 1993010588A1 DE 9200929 W DE9200929 W DE 9200929W WO 9310588 A1 WO9310588 A1 WO 9310588A1
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WO
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fet
supply voltage
arrangement according
voltage
reverse polarity
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Application number
PCT/DE1992/000929
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German (de)
French (fr)
Inventor
Bernhard Mattes
Siegfried Malicki
Original Assignee
Robert Bosch Gmbh
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
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Publication date
Application filed by Robert Bosch Gmbh filed Critical Robert Bosch Gmbh
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    • HELECTRICITY
    • H02GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02HEMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
    • H02H11/00Emergency protective circuit arrangements for preventing the switching-on in case an undesired electric working condition might result
    • H02H11/002Emergency protective circuit arrangements for preventing the switching-on in case an undesired electric working condition might result in case of inverted polarity or connection; with switching for obtaining correct connection
    • H02H11/003Emergency protective circuit arrangements for preventing the switching-on in case an undesired electric working condition might result in case of inverted polarity or connection; with switching for obtaining correct connection using a field effect transistor as protecting element in one of the supply lines

Definitions

  • the voltage limiting device is connected to the gate connections of all FETs via decoupling diodes.
  • the drain-n source channel of a power output stage Fe defective transistor 10 - hereinafter called output stage n-FET - is in series with a consumer 11 and the drain a-source channel of a second one Reverse polarity protection FET 12 serving as reverse polarity protection element.
  • the two source connections (S) are connected to one another, while the drain connection (D) of the output stage FET 10 is connected to the load 11 and the drain connection of the second FET 12 is connected to ground.
  • the second connection of the consumer is connected to the positive pole 13 of a supply voltage source 1 e (Ü).
  • the consumer 11 is supplied by the supply voltage U1 and the gate control of the output stage FET 10 by another supply voltage, namely by the supply voltage U1 '. Both supply voltages, however, control the second FET 12 via the resistor 14, namely the supply voltage U1 via the resistor 21 and the load 11 and the supply Supply voltage U 1 via the diode 27. With the supply voltage U 1 switched on , that is to say in the case of an ignition switched on when used in a motor vehicle, the second FET 12 becomes electrically conductive via the diode 27 and the resistor 14.

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Abstract

Proposed is a reverse-supply protection device for power output stage transistors, the device having, connected in series with the output-stage transistor (10), a reverse-poled FET (12) intended as a reverse-supply protection element. The gate terminal of the reverse-supply protection FET (12) is acted on by a control voltage which is derived from the supply voltage and which controls the FET (12) when the supply voltage is applied correctly. The use of two power transistors (10, 12) therefore gives an output stage which is protected against reversed supply, the FET (12) used as the protection element causing only small voltage losses and having only a low turn-on resistance.

Description

Verpolschutzanordnung für Leistungsendstufen-TransiεtorenReverse polarity protection arrangement for power stage transistors
STAND DER TECHNIKSTATE OF THE ART
Die Erfindung betrifft eine Verpol Schutzanordnung für Leistungsendstufen-Transistoren mit einem in Reihe zum Endstufen-Transistor geschalteten Verpolschutzelement, das bei verpolter Versorgungsspannung sperrt.The invention relates to a polarity reversal protection arrangement for power output stage transistors with a polarity reversal protection element connected in series with the output stage transistor, which blocks when the supply voltage is reversed.
Bei der Herstellung von Le i stungs-FET entsteht prozeßbedingt parallel zum Drai n-Source-Kanal eine Diode, die im Normal¬ betrieb gesperrt ist. Bei Verpolung der Versorgungsspannung wird 'sie jedoch leitend und überbrückt in störender Weise den Drai n-Source- Kanal . Hierdurch wird ein im Lastkreis befindlicher Verbraucher in unerwünschter Weise angesteuert. Bei Endstufen-Transistoren bzw. Verbrauchern, die nicht für den Dauerbetrieb ausgelegt sind, kann dies neben Fehl¬ funktionen zu einer Zerstörung dieser Bauelemente führen. Auch bei bipolaren oder Darlington-Transistoren als Leistungs transistoren liegt eine solche im Normal betr ieb gesperrte und bei Verpolung leitende Diode vor, so daß entsprechende Wirkungen eintreten können.In the production of power FET, a diode arises due to the process, parallel to the drain-source channel, which is blocked in normal operation. Reverse polarity of the supply voltage it is' However, conductive and bridged in a disturbing manner Drai the n-channel source. As a result, a consumer located in the load circuit is undesirably controlled. In the case of output stage transistors or consumers which are not designed for continuous operation, this can, in addition to malfunctions, lead to the destruction of these components. Even with bipolar or Darlington transistors as power transistors there is such a normally blocked diode that conducts polarity reversal, so that corresponding effects can occur.
Um einen Verpolschutz sicherzustellen, ist es bekannt, in Reihe zu einem Le i stungs-FET eine Diode zu schalten, die bei einer Verpolung der Versorgungsspannung sperrt. Im Normal bet ieb bringt jedoch diese Diode einen Spannungs¬ abfall mit sich, um den sich die für den Verbraucher zur Verfügung stehende Spannung vermindert, was vor allem beiIn order to ensure reverse polarity protection, it is known to connect a diode in series with a power FET which blocks in the event of reverse polarity of the supply voltage. In normal operation, however, this diode brings with it a voltage drop by which the voltage available to the consumer is reduced, which is particularly the case
EHSATZBLATT niedrigeren Versorgungsspannungen, wie zum Beispiel der Spannungsversorgung in einem Kraftfahrzeug, von wesentlichem Nachteil sein kann.MARINE LEAF Lower supply voltages, such as the voltage supply in a motor vehicle, can be a significant disadvantage.
Aus der DE-OS 39 30 896 ist die Verwendung eines FET als Verpolschutzelement in allgemeiner Form bekannt, nicht dagegen die Anwendung für Endstufen.From DE-OS 39 30 896 the use of an FET as a polarity reversal protection element is known in general, but not the application for power amplifiers.
VORTEILE DER ERFINDUNGADVANTAGES OF THE INVENTION
Die erfindungsgemäße Verpol Schutzanordnung mit den kenn¬ zeichnenden Merkmalen des Hauptanspruchs hat den Vorteil , daß bei sicherem Verpol schütz in der Leistungs-Endstufe nur geringe Spannungsverluste bei nichtverpoltem Betrieb auftreten. Dabei kann ein sehr kleiner Einschaltwiderstand erreicht werden. Für vollständig integrierte Endstufen ist diese Verpolschutzanordnung in besonderer Weise geeig¬ net.The polarity reversal protection arrangement according to the invention with the characterizing features of the main claim has the advantage that with safe polarity reversal protection in the power output stage, only slight voltage losses occur during operation with no polarity reversal. A very low switch-on resistance can be achieved. This reverse polarity protection arrangement is particularly suitable for fully integrated output stages.
Durch die in den Unteransprüchen aufgeführten Maßnahmen sind vorteilhafte Weiterbildungen und Verbesserungen der im Hauptanspruch angegebenen Verpolschutzanordnung möglich.The measures listed in the subclaims permit advantageous developments and improvements of the polarity reversal protection arrangement specified in the main claim.
Ist der Endstufen-Transistor als FET ausgebildet, so können er und der Verpolschutz-FET in vorteil after Weise identisch ausgebildet sein, um die Herstellung der Endstufe insgesamt zu vereinfachen. Auch bei der vollständigen Integration ist dies von Vorteil.If the output stage transistor is designed as an FET, it and the reverse polarity protection FET can advantageously be of identical design in order to simplify the manufacture of the output stage as a whole. This is also an advantage with full integration.
Bei einer Schaltungsausführung mit einem FET als Endstufen- Transistor sind zweckmäßigerweise die Source-Anschlüsse der beiden FETs miteinander verbunden, während bei einer Schaltungsausführung mit einem bipolaren oder Darl ngton- Transistor der Emitter dieses Transistors mit dem Source- Anschluß des Verpolschutz-FET verbunden ist. Dabei ist insbesondere der Drain-Anschluß des Verpolschutz-FET mit Masse und der Kollektor- oder Drai n- Anschl uß des Endstufen- Transistors über einen durch diesen gesteuerten Verbraucher mit dem positiven Pol der Versorgungsspannung verbunden.In the case of a circuit design with an FET as an output stage transistor, the source connections of the two FETs are expediently connected to one another, while in the case of a circuit design with a bipolar or Darling tone transistor, the emitter of this transistor is connected to the source connection of the polarity reversal protection FET. It is in particular the drain terminal of the polarity reversal protection FET is connected to ground and the collector or drain terminal of the output stage transistor is connected via a consumer controlled by this to the positive pole of the supply voltage.
Zum Schutz gegen Überspannungen ist eine mit wenigstens einem Teil der Versorgungsspannung beaufschlagte Spannungs- begrenzungsvorr i chtung mit wenigstens einem Gate-Anschluß des Verpolschutz-FET zur Begrenzung der Gate-Spannung auf einen unterhalb des kritischen Werts liegenden Wert ver¬ bunden. Hierdurch wird nicht nur ein Schutz des FET erreicht, sondern dieser wird auch bei unverpolter Versorgungsspannung sicher im stromleitenden Zustand gehalten. Als derartige Spannungsbegrenzungs vorr i chtung eignet sich insbesondere e ine Z-Diode .To protect against overvoltages, a voltage limiting device to which at least part of the supply voltage is applied is connected to at least one gate connection of the polarity reversal protection FET to limit the gate voltage to a value below the critical value. This not only ensures protection of the FET, but it is also kept safely in the current-carrying state even when the supply voltage is not reversed. A Z diode is particularly suitable as such a voltage limiting device.
Um bei einer Schal tungs ausführung bei zwei FETs mit einer einzigen, insbesondere als Z-Diode ausgebildeten Spannungs- begrenzungsvorri chtung beide FETs zu schützen, wird die Spannungsbegrenzungsvorrichtung über Entkopplungsdioden mit den Gate-Anschlüssen aller FETs verbunden.In order to protect both FETs in a circuit configuration with two FETs with a single voltage limiting device, in particular as a Z diode, the voltage limiting device is connected to the gate connections of all FETs via decoupling diodes.
Um den Verpolschutz-FET bei unverpolter Ve sorgungsspannung aufzusteuern und im verpolten Zustand zu sperren, ist der positive Pol der Versorgungsspannung zweckmäßigerweise über wenigstens einen Widerstand mit dem Gate-Ansch 1 uß dieses Verpolschutz-FET verbunden (inverser Betrieb ist be i FETs mögl ich).In order to open the reverse polarity protection FET when the supply voltage is not reversed and to block it in the reverse polarity, the positive pole of the supply voltage is expediently connected to the gate connection of this reverse polarity protection FET via at least one resistor (inverse operation is possible with FETs) .
Derartige Leistungsendstufen können in Spannungsnetzen eingesetzt sein, bei denen unterschiedlich geschaltete Versorgungsspannungen vorl iegen, beispielsweise im Kraft¬ fahrzeug, wo Leistungsendstufen von einer ersten Versorgungs¬ spannung versorgt werden (ständig anl iegende Batteriespan¬ nung), während ein Steuers i gnal te i 1 für die Leistungsend- stufe von einer anderen zweiten Versorgungsspannung (die über ein Zündschloß geschaltete Batteriespannung) versorgt wird. Um bei diesen Verhältnissen einen sicheren Verpol- schutz zu erreichen, ist vortei lhafterwe ise der Gate-Anschluß des Verpolschutz-FET mit von beiden Versorgungsspannungen abgeleiteten, jeweils diesen Verpolschutz-FET bei korrekt gepolten Versorgungss-pannungen und bei sperrendem Endstufen- Transistor aufsteuernden Steuerspannungen beaufschlagt. Hierdurch ist auch beispielsweise der Verpolschutz noch gewährleistet, wenn be abgeschalteter zweiter Versorgungs¬ spannung die erste Versorgungsspannung verpolt ist, also beispielsweise die Batterie falsch angeschlossen ist. Durch diese Anordnung kann der Anschluß für die aus der ersten Versorgungsspannung gewonnene Steuerspannung zwischen dem E-ndstufen-Trans istor und dem von diesem gesteuerten Ver¬ braucher angeordnet sein, muß also beispielsweise nicht an der sogenannten "Klemme 30" in einem Kraftfahrzeug ange¬ schlossen sein.Such power output stages can be used in voltage networks in which there are differently switched supply voltages, for example in the motor vehicle, where power output stages are supplied by a first supply voltage (constantly applied battery voltage), while a control signal i 1 for the power end stage is supplied by another second supply voltage (the battery voltage switched via an ignition lock). In order to achieve reliable polarity reversal protection under these conditions, the gate connection of the polarity reversal protection FET is advantageously acted upon with control voltages derived from both supply voltages, in each case this polarity reversal protection FET with correctly polarized supply voltages and with a blocking final stage transistor . This also ensures, for example, reverse polarity protection if the first supply voltage is reversed when the second supply voltage is switched off, for example if the battery is incorrectly connected. As a result of this arrangement, the connection for the control voltage obtained from the first supply voltage can be arranged between the output stage transistor and the consumer controlled by it, so it does not have to be connected, for example, to the so-called "terminal 30" in a motor vehicle his.
Eine weitere vorteilhafte Schaltungsanordnung besteht darin, daß die zweite Versorgungsspannung über eine Diode an einer Widerstandsanordnung anliegt, über -die die erste Versorgungs¬ spannung an den Gate-Anschluß des Verpolschutz-FET gelegt ist.Another advantageous circuit arrangement consists in that the second supply voltage is applied via a diode to a resistor arrangement, via which the first supply voltage is applied to the gate connection of the polarity reversal protection FET.
ZEICHNUNGDRAWING
Vier Ausführungsbeispiele der Erfindung sind in der Zeich¬ nung dargestellt und in der nachfolgenden Beschreibung näher erläutert. Es zeigen:Four exemplary embodiments of the invention are shown in the drawing and are explained in more detail in the description below. Show it:
Fig. 1 eine Schaltungsanordnung eines ersten Ausführungs¬ beispiels mit einem FET-Leitungstransistor und mit einer Versorgungsspannung, Fig. 2 eine Schaltungsanordnung eines zweiten Ausführungs beispiels mit einem FET-Le i stungstrans i stör und mit zwei Versorgungsspannungen,1 shows a circuit arrangement of a first embodiment with an FET line transistor and with a supply voltage, 2 shows a circuit arrangement of a second embodiment example with a FET power transmission fault and with two supply voltages,
Fig. 3 eine Schaltungsanordnung eines dritten Ausf'üh- rungsbe i spi el s mit einem bipolaren Leistungs¬ trans i stör- und mit einer Versorgungsspannung undFig. 3 shows a circuit arrangement of a third embodiment 'üh- rungsbe i spi el s with a bipolar trans Leistungs¬ i fault and with a supply voltage and
Fig eine Schaltungsanordnung eines vierten Ausführungs' beispiels mit einem Darl ington-Leistungstransistor und mit zwei Versorgung Spannungen .Fig. A circuit arrangement of a fourth embodiment 'example with a Darling tone power transistor and with two supply voltages.
BESCHREIBUNG DER AUSFUHRUNGSBEISPIELEDESCRIPTION OF THE EXEMPLARY EMBODIMENTS
Bei dem in Fig. 1 dargestellten Ausführungsbeispiel ist der Drai n-Source-Kanal eines Leistungsendstufen-Fe deffekt- Transistoros 10 - im folgenden Endstufe n-FET genannt - in Reihe zu einem Verbraucher 11 und dem Dr a i n-Source -Kanal eines zweiten als Verpolschutzelement dienenden Verpolschutz FET 12 geschaltet. Dabei sind die beiden Source -Anschl üsse (S) miteinander verbunden, während der Drai n-Ansch 1 uß (D) des Endstufen-FET 10 mit dem Verbraucher 11 und der Drain- Anschluß des zweiten FET 12 mit Masse verbunden ist. Der Verbraucher ist mit seinem zweiten Anschluß mit dem positi¬ ven Pol 13 einer Versorgungsspannungsquel 1 e (Üb) verbunden.In the exemplary embodiment shown in FIG. 1, the drain-n source channel of a power output stage Fe defective transistor 10 - hereinafter called output stage n-FET - is in series with a consumer 11 and the drain a-source channel of a second one Reverse polarity protection FET 12 serving as reverse polarity protection element. The two source connections (S) are connected to one another, while the drain connection (D) of the output stage FET 10 is connected to the load 11 and the drain connection of the second FET 12 is connected to ground. The second connection of the consumer is connected to the positive pole 13 of a supply voltage source 1 e (Ü).
Der positive Pol 13 ist weiterhin über einen Widerstand 14 mit dem Gate-Anschluß (G) des zweiten FET 12 und über einen Widerstand 15 mit dem Gate-Anschluß (G) des Endstufen FET 10 verbunden. Eine Z-Diode 16 l iegt mit ihrer Anode an Masse, während ihre Kathode über eine erste Diode 17 mit dem Gate-Anschluß des zweiten FET 12 und über eine zweite Diode 18 mit dem Gate-Anschluß des Endstufen-FET 10 verbunden ist. Die Dioden 17,18 sind dabei gegensinnig zur Z-Diode 16 geschaltet. Schließlich ist ein Steueranschluß 19 für den Endstufen-FET 10 über einen Widerstand 20 mit dem Gate-Anschluß dieses Endstufen-FET 10 verbunden.The positive pole 13 is also connected via a resistor 14 to the gate connection (G) of the second FET 12 and via a resistor 15 to the gate connection (G) of the output stage FET 10. A Z diode 16 is connected to ground with its anode, while its cathode is connected via a first diode 17 to the gate connection of the second FET 12 and via a second diode 18 to the gate connection of the output stage FET 10. The diodes 17, 18 are in opposite directions switched to the Zener diode 16. Finally, a control connection 19 for the output stage FET 10 is connected via a resistor 20 to the gate connection of this output stage FET 10.
Die Wirkungsweise des in Fig. 1 dargestellten Ausführungs¬ beispiels besteht darin, daß der als Verpolschutz dienende FET 12 iπvers zum Endstufen-FET 10 betrieben wird. Die prozeßbedingt parallel zum Drain-Source-Kanal derartiger FETs entstehende Diode (Inversdiode) ist jeweils symbolisch dargestellt. Im nichtverpolten, korrekten Betrieb ist der zweite FET 12 ständig leitend, da sein Gate-Anschluß über einen Widerstand 14 mit einem entsprechenden positiven Potential beaufschlagt wird. Dieses wird durch die Z-Diode 16 auf einen für den FET 12 ungefährlichen Wert unter 10 Volt begrenzt, beispielsweise auf 9,1 Volt. Eine entsprechen¬ de Spannungsbegrenzung erfolgt auch durch dieselbe Z-Diode und die Diode 18 für den Endstufen-FET 10. Dieser kann durch entsprechende Steuersignalfolgen am Steueranschluß 19 über die Widerstände 15,20 angesteuert werden. An der Drain-Source-Strecke des zweiten FET 12 entstehen dabei geringe Spannungsverluste bei kleinem Einschaltwiderstand.The mode of operation of the embodiment shown in FIG. 1 consists in that the FET 12 serving as reverse polarity protection is operated inversely to the output stage FET 10. The diode (inverse diode) created parallel to the drain-source channel of such FETs as a result of the process is shown symbolically in each case. In correct operation without reverse polarity, the second FET 12 is always conductive since its gate connection is acted upon by a resistor 14 with a corresponding positive potential. This is limited by the Zener diode 16 to a value below 10 volts, which is harmless for the FET 12, for example to 9.1 volts. A corresponding voltage limitation is also carried out by the same Z-diode and the diode 18 for the output stage FET 10. This can be controlled by corresponding control signal sequences at the control connection 19 via the resistors 15, 20. At the drain-source path of the second FET 12, there are slight voltage losses with a small on-resistance.
Bei verpoltem Betrieb, also bei vertauschten Anschlüssen von Masse und positivem Pol der Versorgungsspannung Üb, liegt der Gate-Anschluß des zweiten FET 12 an Masse, also an 0 Volt. Auch der Source-Anschl uß dieses zweiten FET 12 liegt über die Reihenschaltung der Invers-Diode des End¬ stufen-FET 10 und dem Verbraucher 11 an 0 Volt. Somit ist der zweite FET 12 gesperrt, und die Kathode der Invers- Diode des zweiten FET 12 liegt jetzt an +Ub, wodurch sie gesperrt ist. Hierdurch ist eine sichere Verpolfestigkeit der Endstufe gewährleistet.With reverse polarity operation, that is, with reversed connections of ground and positive pole of the supply voltage U1, the gate connection of the second FET 12 is connected to ground, that is to 0 volts. The source connection of this second FET 12 is also connected to 0 volts via the series connection of the inverse diode of the output stage FET 10 and the consumer 11. The second FET 12 is thus blocked and the cathode of the inverse diode of the second FET 12 is now connected to + Ub, as a result of which it is blocked. This ensures that the output stage is protected against polarity reversal.
Das in Fig. 2 dargestellte zweite Ausführungsbeispiel ent¬ spricht weitgehend dem ersten Ausführungsbeispiel, so daß - 7 -The second exemplary embodiment shown in FIG. 2 largely corresponds to the first exemplary embodiment, so that - 7 -
gleiche oder gleichwirkende Bauteile mit denselben Bezugs¬ zeichen versehen und nicht nochmals beschrieben sind.Identical or equivalent components are provided with the same reference symbols and are not described again.
Im Unterschied zum ersten Ausführungsbeispiel ist der Wider¬ stand 14 nicht mi dem positiven Pol 13, sondern über einen weiteren Widerstand 21 mit dem D ain-Anschluß des Endstufen-FET 10 verbunden. Die Spannungs ersorgung des Widerstands 15 erfolgt nicht über den positiven Pol 13, sondern über ein 'Spannungsversorgungsteil 22. Dieses wird versorgungsseiti g über eine Klemme 23 gespeist, die an eine weitere Versorgungsspannung Üb' angeschlossen ist. In einem Kraftfahrzeug entspricht der positive Pol 13 bei¬ spielsweise der sogenannten "Klemme 30", die ständig mit dem positiven Pol der Kraftfahrzeugbatte ie verbunden ist. Demgegenüber entspricht die Klemme 23 der sogenannten "Klemme 25" im Kraftfahrzeug, die in Abhängigkeit der Schaltstel¬ lung eines hier nicht dargestellten Zündschalters entweder mit der Klemme 30 verbunden oder von dieser getrennt ist.In contrast to the first exemplary embodiment, the resistor 14 is not connected to the positive pole 13, but to the D ain connection of the output stage FET 10 via a further resistor 21. The voltage supply of the resistor 15 does not take place via the positive pole 13, but via a ' voltage supply part 22. This is supplied on the supply side via a terminal 23 which is connected to a further supply voltage U1'. In a motor vehicle, the positive pole 13 corresponds, for example, to the so-called “terminal 30”, which is permanently connected to the positive pole of the motor vehicle battery. In contrast, the terminal 23 corresponds to the so-called "terminal 25" in the motor vehicle, which depending on the switching position of an ignition switch (not shown here) is either connected to the terminal 30 or separated from it.
Die Klemme 23 ist über die Reihenschaltung einer Diode 24 mit einem Widerstand 25 mit dem Widerstand 15 verbunden, wobei der Verknüpfungspunkt zwischen den Widerständen 25,15 über eine Z-Diode 26 zur Spannungsstabilisierung an Masse liegt. Weiterhin ist die Klemme 23 über eine Diode 27 mit dem Verknüpfungspunkt zwischen den Widerständen 14,21 ver¬ bunden. Die Dioden 24,27 dienen dabei zur Spannungsent¬ koppel ung.Terminal 23 is connected via a series connection of a diode 24 with a resistor 25 to resistor 15, the connection point between resistors 25, 15 being connected to ground via a Zener diode 26 for voltage stabilization. Furthermore, the terminal 23 is connected via a diode 27 to the connection point between the resistors 14, 21. The diodes 24, 27 are used for voltage decoupling.
In diesem Ausführungsbeispiel wird der Verbraucher 11 von der Versorgungsspannung Üb und die Gate-Ansteuerung des Endstufen-FET 10 von einer anderen Versorgungsspannung versorgt, nämlich von der Versorgungsspannung Üb' . Beide Versorgungsspannungen steuern jedoch über den Widerstand 14 den zweiten FET 12, nämlich die Versorgungsspannung Üb über den Widerstand 21 sowie die Last 11 und die Ver- sorgungsspannung Üb1 über die Diode 27. Bei eingeschalteter Versorgungsspannung Üb1, also im Falle einer eingeschalteten Zündung bei der Verwendung in einem Kraftfahrzeug, wird der zweite FET 12 über die Diode 27 und den Widerstand 14 stromleitend. Bei abgeschalteter Versorgungsspannung Üb', also zum Beispiel bei ausgeschalteter Zündung im Kraft¬ fahrzeug, wird der zwe'ite FET 12 dagegen über den Verbraucher 11 und die Widerstände 21,14 stromleitend. Zur Versorgung der Schaltung bzw. des zweiten FET 12 ist daher lediglich eine Verbindung zur Klemme 23 erforderl ch, nicht mehr dagegen zum positiven Pol 13, da hier die Verbindung mit dem Verbraucher 11 ausreicht. Die Endstufe ist in jedem Fall verpolgesichert, beispielsweise auch bei abgeschalteter Versorgungsspannung Üb1 und verpolter Versorgungsspannung Üb.In this exemplary embodiment, the consumer 11 is supplied by the supply voltage U1 and the gate control of the output stage FET 10 by another supply voltage, namely by the supply voltage U1 '. Both supply voltages, however, control the second FET 12 via the resistor 14, namely the supply voltage U1 via the resistor 21 and the load 11 and the supply Supply voltage U 1 via the diode 27. With the supply voltage U 1 switched on , that is to say in the case of an ignition switched on when used in a motor vehicle, the second FET 12 becomes electrically conductive via the diode 27 and the resistor 14. When the supply voltage U1 is switched off, that is to say, for example, when the ignition in the motor vehicle is switched off, the second FET 12, on the other hand, becomes electrically conductive via the consumer 11 and the resistors 21, 14. To supply the circuit or the second FET 12, therefore, only a connection to the terminal 23 is required, but no longer to the positive pole 13, since the connection to the consumer 11 is sufficient here. The final stage is verpolgesichert in any case, for example, when the supply voltage Ub 1 and reverse polarity supply voltage Ub.
Das in Fig. 3 dargestellte dritte Ausführungsbeispiel ent¬ spricht im großen und 'ganzen dem in Fig. 1 dargestellten ersten Ausführungsbeispiel, wobei als wesentlicher Unter¬ schied nunmehr anstelle des Endstufen-FET 10 ein bipolarer, als npn ausgebildeter Transistor 30 als Leistungsendstufen- Transistor vorgesehen ist, dessen Emitter mit dem Source- Anschluß (S) des Verpolschutz-FET 12 verbunden ist. Die Z-Diode 16 ist nunmehr in Reihe mit einer Diode 35 zwischen den Gate-Anschluß (G) und den Source-Anschluß (S) des Ver¬ polschutz-FET 12 geschaltet, um wie beim ersten Ausführungs¬ beispiel das Gate-Potential auf einen ungefährlichen Wert zu begrenzen, wenn der Verpolschutz-FET 12 leitet. Da dies beim bipolaren Transistor 30 nicht unbedingt erforderlich ist, entfallen die Dioden 17 und 18. Dabei ersetzt die Diode 35 die Diode 17 und ermöglicht das Aufsteuern des invers betriebenen Verpolschutz-FETs 12, ohne daß die Z- Diode 16 die Source-Gate-Spannung in diesem Falle begrenzen kann. Die Wirkungweise entspricht im wesentl ichen der des ersten Ausführungsbeispiels, so daß auf diese verwiesen wird. Anstelle der prozeßbedingt parallel zum Dr ai n-Source-Kanal des Endstufen-FET 10 in Fig. 1 entstehenden Diode (Invers- Diode) tritt hier die durch die Basis-Emitter-Strecke gebil¬ dete Diode, die bei Verpolung in Sperrichtung betrieben wird und durchbrechen "könnte.The illustrated in Fig. 3 ent third embodiment speaks in large and 'all the first embodiment shown in Fig. 1, as an essential difference Unter¬ now instead of the final-stage FET 10, a bipolar, NPN transistor 30 configured as a power stage transistor is provided, whose emitter is connected to the source terminal (S) of the reverse polarity protection FET 12. The Zener diode 16 is now connected in series with a diode 35 between the gate connection (G) and the source connection (S) of the polarity reversal protection FET 12 in order, as in the first embodiment, to set the gate potential limit a non-hazardous value when the reverse polarity protection FET 12 conducts. Since this is not absolutely necessary in the case of the bipolar transistor 30, the diodes 17 and 18 are dispensed with. The diode 35 replaces the diode 17 and enables the reverse-polarity reversal protection FET 12 to be driven on without the Z diode 16 causing the source gate Can limit tension in this case. The mode of operation corresponds essentially to that of the first exemplary embodiment, so that reference is made to this. Instead of the process-related diode (inverse diode) which arises parallel to the drain-source channel of the output stage FET 10 in FIG. 1, the diode formed by the base-emitter path, which is operated in the reverse direction if the polarity is reversed, is used here and break through " .
Das in Fig. 4 dargestellte vierte Ausführungsbeispiel ent- spricht weitgehend dem in Fig. 2 dargestellten zweiten Ausführungsbeispiel , wobei wiederum gleiche oder gleich¬ wirkende Bauteile und Baugruppen mit denselben Bezugszeichen versehen und nicht nochmals beschrieben sind. Bei diesem Ausführungsbeispiel tritt anstelle des Le i stungs-FET 10 ein npn-Darl ington-Tr ans i stör 31. Auch hier ist - wie beim dritten Ausführungsbeispiel - die Z-Diode 16 in Reihe mit der Z-Diode 35 zur Spannungsbegrenzung zwischen den Gate- Anschluß (G) und den Source- Anschluß (S) des Verpolschutz- FET 12 geschaltet, wobei auch hier die beiden Dioden 17 und 18 entsprechend entfallen. Zusätzl ich ist zwischen dem Steueranschluß 19 und dem Widerstand 20 eine Entkopp¬ lungsdiode 32 und zwischen diesen Widerstand 20 und die Basis des Darlington-Transistors 31 eine weitere Diode 33 geschaltet. Ein Ableitwiderstand 34 ist zusätzl ich zwi¬ schen Basis und Emitter des Darl ington-Transistors 31 ge¬ schal tet .The illustrated in Fig. 4 fourth embodiment corresponds speaks to the second embodiment shown in Fig. 2 largely, again the same or gleich¬ acting components and assemblies provided with the same reference numerals and are not described again. In this embodiment, instead of the power FET 10, an npn Darlington-Tr ans i disturbance 31. Here too - as in the third embodiment - the Z diode 16 is in series with the Z diode 35 for voltage limitation between the The gate connection (G) and the source connection (S) of the reverse polarity protection FET 12 are connected, the two diodes 17 and 18 also being omitted here accordingly. In addition, a decoupling diode 32 is connected between the control connection 19 and the resistor 20 and a further diode 33 is connected between this resistor 20 and the base of the Darlington transistor 31. A bleeder resistor 34 is additionally switched between the base and emitter of the Darlington signal transistor 31.
Auch hier entspricht die Wirkungsweise derjenigen des in Fig. 2 dargestell en zweiten Ausführungsbeispiels, so daß hierauf verwiesen werden kann. Die Diode 33 gewährleistet ein sichereres Sperren des Da lington-Transistors 31 bzw. unterstützt die Sperrbedingungen. Da sie im Verpolfall leitet, wird die Entkopplungsdiode 32 in der beschriebe¬ nen Weise geschaltet, da sonst ein zu großer Stromfluß durch den im Vergleich zum Widerstand 15 sehr kleinen Wider- stand 20 fließen würdeHere too, the mode of operation corresponds to that of the second exemplary embodiment shown in FIG. 2, so that reference can be made to this. The diode 33 ensures a more secure blocking of the Da lington transistor 31 and supports the blocking conditions. Since it conducts in the event of polarity reversal, the decoupling diode 32 is switched in the manner described, since otherwise an excessive current flow through the resistor, which is very small in comparison with the resistor 15, stood 20 would flow
Selbstverständlich kann beim in Fig. 3 dargestellten dritten Ausführungsbeispiel auch ein Darl ngton-Transistor vorge¬ sehen sein, während andererseits im in Fig. 4 dargestellten vierten Ausführungsbeispiel ein bipolarer Transistor gemäß Fig. 3 geschaltet sein kann. Of course, in the third exemplary embodiment shown in FIG. 3, a Darong tone transistor can also be provided, while on the other hand, in the fourth exemplary embodiment shown in FIG. 4, a bipolar transistor according to FIG. 3 can be connected.

Claims

Ansprüche Expectations
1. Verpolschutzanordnung für Leistungsendstufen-Transisto¬ ren mit einem in Reihe zum Endstufen-Transistor geschalteten Verpolschutzelement, das bei verpolter Versorgungsspannung sperrt, dadurch gekennzeichnet, daß das Verpolschu z¬ element als zum Endstufen-Transistor (10; 30; 31) invers gepolter Verpolschutz-FET (12) ausgebildet ist, dessen Gate-Anschluß mit einer von der Versorgungsspannung abge¬ leiteten, den FET (12) bei korrekt gepolter Versorgungs¬ spannung aufs teuernde n Steuerspannung beaufschlagt ist.1. polarity reversal protection arrangement for power stage transistors with a series-connected polarity reversal protection element which blocks in the event of a polarized supply voltage, characterized in that the polarity reversal element as to the output stage transistor (10; 30; 31) inversely polarized polarity reversal protection -FET (12) is formed, the gate connection of which is derived from the supply voltage and the FET (12) is charged to the expensive control voltage if the supply voltage is correctly polarized.
2. Verpolschutzanordnung nach Anspruch 1, dadurch gekenn¬ zeichnet, daß der Endstufen-Transistor (30; 31) als bi¬ polarer oder Darl ington-Transistor ausgebildet ist.2. Reverse polarity protection arrangement according to claim 1, characterized gekenn¬ characterized in that the output stage transistor (30; 31) is designed as a bi-polar or Darling tone transistor.
3. Verpolschutzanordnung nach Anspruch 2, dadurch gekenn¬ zeichnet, daß der Emitter des Endstufen-T ansisto s (30; 31) mit dem Source- Ansch luß (S) des Verpolschutz-FET (12) verbunden i st.3. reverse polarity protection arrangement according to claim 2, characterized gekenn¬ characterized in that the emitter of the final stage T ansisto s (30; 31) with the source connection (S) of the reverse polarity protection FET (12) i st.
4. Verpolschutzanordnung nach Anspruch 1, dadurch gekenn¬ zeichnet, daß der Endstufen-Transistor (10) als FET ausge- bi 1 det i st.4. polarity reversal protection arrangement according to claim 1, characterized gekenn¬ characterized in that the output stage transistor (10) as FET- bi 1 det i st.
5. Verpolschutzanordnung nach Anspruch 4, dadurch gekenn¬ zeichnet, daß die beiden FETs (10,12) im wesentl ichen identisc sind. 5. Reverse polarity protection arrangement according to claim 4, characterized gekenn¬ characterized in that the two FETs (10, 12) are identisc in essence.
6. Verpolschutzanordnung nach Anspruch 4 oder 5, dadurch gekennzeichnet, daß die Source-Anschlüsse (S) der beiden FETs (10,12) miteinander verbunden sind.6. Reverse polarity protection arrangement according to claim 4 or 5, characterized in that the source connections (S) of the two FETs (10, 12) are connected to one another.
7. Verpolschutzanordnung nach Anspruch 3 oder 6, dadurch gekennzeichnet, daß der Drain-Anschluß (D) des Verpolschutz- FET (12) mit Masse und der Kollektor- oder Drain-Anschluß (D) des Endstufen-Trans stors (10; 30; 31) über einen durch diesen gesteuerten Verbraucher (11) mit dem positiven Pol (13) der Versorgungsspannung verbunden ist.7. polarity reversal protection arrangement according to claim 3 or 6, characterized in that the drain connection (D) of the polarity reversal protection FET (12) with ground and the collector or drain connection (D) of the final stage trans stors (10; 30; 31) is connected via a consumer (11) controlled by this to the positive pole (13) of the supply voltage.
8. Verpolschutzanordnung nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, daß eine mit wenigstens einem Teil der Versorgungsspannung beaufschlagte Spannungs- begrenzungsvorrichtung (16) mit wenigstens dem Gate-Anschluß (G) des Verpolschutz-FET (12) zur Begrenzung der Gate- Spannung auf den unterhalb des kritischen Werts liegenden Wert verbunden ist.8. polarity reversal protection arrangement according to one of the preceding claims, characterized in that a voltage limiting device (16) acted on with at least part of the supply voltage with at least the gate terminal (G) of the polarity reversal protection FET (12) for limiting the gate voltage is linked to the value below the critical value.
9. Verpolschutzanordnung nach Anspruch 8, dadurch gekenn¬ zeichnet, daß die Spannungsbegrenzungsvorr ichtung (16) als Z-Diode ausgebildet ist.9. polarity reversal protection arrangement according to claim 8, characterized gekenn¬ characterized in that the voltage limiting device (16) is designed as a Zener diode.
10. Verpolschutzanordnung nach Anspruch 8 oder 9, dadurch gekennzeichnet, daß die Spannungsbegrenzungsvorrichtung (16) über Entkopplungsdioden (17,18,35) mit den Gate-An¬ schlüssen (G) aller FETs (10,12) verbunden ist.10. Reverse polarity protection arrangement according to claim 8 or 9, characterized in that the voltage limiting device (16) via decoupling diodes (17, 18, 35) is connected to the gate connections (G) of all FETs (10, 12).
11. Verpolschutzanordnung nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, daß der positive Pol (13) der Versorgungsspannung über wenigstens einen Wider¬ stand (14,21) mit dem Gate-Anschluß (G) des Verpolschutz- FET (12) verbunden ist.11. Reverse polarity protection arrangement according to one of the preceding claims, characterized in that the positive pole (13) of the supply voltage is connected via at least one resistor (14, 21) to the gate connection (G) of the reverse polarity protection FET (12).
12. Verpolschutzanordnung nach einem der Ansprüche 1 bis 10 f ür eine Leistungsendstufe, die von einer ersten Ver¬ sorgungsspannung (Üb) versorgt wird, während ein Steuer¬ signalteil für die Leistungsendstufe von einer anderen, zweiten Versorgungsspannung (Üb1 ) versorgt wird, dadurch gekennzeichnet, daß der Gate-Anschluß (G) des Verpolschutz- FET (12) mit von beiden Versorgungsspannungen (Üb, Üb' ) abgeleiteten, jewe i 1 s 'diesen FET (12) bei korrekt gepolter Versorgungsspannung und bei sperrendem Endstufen-Transistor (10,31) aufsteuernden Steuerspannungen beaufschlagt wird.12. Reverse polarity protection arrangement according to one of claims 1 to 10 for a power output stage, which is supplied by a first supply voltage (Ü), while a control signal part for the power output stage is supplied by another, second supply voltage (Ü 1 ), characterized in that the gate connection (G ) of the polarity reversal protection FET (12) with control voltages derived from both supply voltages (Exercise, Exercise '), this FET (12) is applied to the FET (12) with a correctly polarized supply voltage and with a blocking output stage transistor (10,31).
13. Verpolschutzanordnung nach Anspruch 12, dadurch gekenn¬ zeichnet, daß der Anschluß für die aus der ersten Versorgungs Spannung (Üb) gewonnenen Steuerspannung für den Verpol¬ schutz-FET (12) der Kollektor- oder Dr a i n-Anschl uß (D) des Endstufen-Transi stören (10; 31) ist.13. Reverse polarity protection arrangement according to claim 12, characterized gekenn¬ characterized in that the connection for the control voltage obtained from the first supply voltage (ÜB) for the reverse polarity protection FET (12) of the collector or drain connection (D) of the output stage transis disturb (10; 31).
14. Verpolschutzanordnung nach Anspruch 12 oder 13, dadurch gekennzeichnet, daß die zweite Versorgungsspannung (Üb1 ) über eine Diode (27) an einer iderstandsanordnung (14,21) l iegt, über die die erste Versorgungsspannung (Üb) an den Gate-Anschluß des Verpolschutz-FET (12) gelegt ist.14. Reverse polarity protection arrangement according to claim 12 or 13, characterized in that the second supply voltage (Ü 1 ) via a diode (27) on a resistor arrangement (14, 21) lies, via which the first supply voltage (Ü) to the gate connection the reverse polarity protection FET (12).
15. Verpolschutzanordnung nach einem der Ansprüche 12 bis 14 f ür die Anordnung in einem Kraftfahrzeug, dadurch gekenn¬ zeichnet, daß die erste Versorgungsspannung (Üb) die ständig anliegende Batteriespannung und die zweite Versorgungs¬ spannung (Üb1 ) die über ein Zündschloß geschaltete Batterie¬ spannung ist. 15. Reverse polarity protection arrangement according to one of claims 12 to 14 for the arrangement in a motor vehicle, characterized gekenn¬ characterized in that the first supply voltage (Ü) the constantly applied battery voltage and the second supply voltage (Ü 1 ) the battery connected via an ignition lock ¬ voltage.
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