JP2003208132A - 液晶駆動回路 - Google Patents
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Abstract
(57)【要約】
【課題】 余計なラッチ回路を追加することなくＤＡＣ
及びオペアンプの数を減少させることにより、消費電力
やチップ面積を抑えた液晶駆動回路を提供する。 【解決手段】 液晶駆動回路は、入力された画像データ
を一時的に記憶する記憶回路１０と、記憶回路から読み
出された複数チャンネルの画像データを順次選択して時
分割で出力する第１の選択回路４１〜４３と、第１の選
択回路から時分割で出力された画像データをアナログ画
像信号に変換するディジタル／アナログ変換回路２０
と、ディジタル／アナログ変換回路によって得られたア
ナログ画像信号を増幅する増幅回路３０と、複数の出力
端子を順次選択することにより、増幅回路によって増幅
されたアナログ画像信号を複数の出力端子に時分割で分
配する第２の選択回路５１〜５３とを具備する。
及びオペアンプの数を減少させることにより、消費電力
やチップ面積を抑えた液晶駆動回路を提供する。 【解決手段】 液晶駆動回路は、入力された画像データ
を一時的に記憶する記憶回路１０と、記憶回路から読み
出された複数チャンネルの画像データを順次選択して時
分割で出力する第１の選択回路４１〜４３と、第１の選
択回路から時分割で出力された画像データをアナログ画
像信号に変換するディジタル／アナログ変換回路２０
と、ディジタル／アナログ変換回路によって得られたア
ナログ画像信号を増幅する増幅回路３０と、複数の出力
端子を順次選択することにより、増幅回路によって増幅
されたアナログ画像信号を複数の出力端子に時分割で分
配する第２の選択回路５１〜５３とを具備する。
Description
【０００１】
【発明の属する技術分野】本発明は、一般に、ＬＣＤ
（Liquid Crystal Display：液晶表示装置）を駆動する
ための液晶駆動回路に関し、特に、一部のＬＣＤにおい
て用いられているＴＦＴ（Thin Film Transistor：薄膜
トランジスタ）のソースを駆動する液晶駆動回路に関す
る。
（Liquid Crystal Display：液晶表示装置）を駆動する
ための液晶駆動回路に関し、特に、一部のＬＣＤにおい
て用いられているＴＦＴ（Thin Film Transistor：薄膜
トランジスタ）のソースを駆動する液晶駆動回路に関す
る。
【０００２】
【従来の技術】ＬＣＤに用いられているＴＦＴのソース
を駆動する液晶駆動回路（ソースドライバ）において
は、ＲＡＭ（Random Access Memory：ランダムアクセス
メモリ）から読み出されたディジタルの画像データが、
ＤＡＣ（Digital to Analog Converter：ディジタル／
アナログ変換器）によってアナログ画像信号に変換さ
れ、このアナログ画像信号がオペアンプによって増幅さ
れて、ＴＦＴのソースラインに供給される。
を駆動する液晶駆動回路（ソースドライバ）において
は、ＲＡＭ（Random Access Memory：ランダムアクセス
メモリ）から読み出されたディジタルの画像データが、
ＤＡＣ（Digital to Analog Converter：ディジタル／
アナログ変換器）によってアナログ画像信号に変換さ
れ、このアナログ画像信号がオペアンプによって増幅さ
れて、ＴＦＴのソースラインに供給される。
【０００３】図７に、従来の液晶駆動回路の一部と液晶
表示装置の一部を示す。図７には、赤色（Ｒ）、緑色
（Ｇ）、青色（Ｂ）の画像データを一時的に記憶するＲ
ＡＭ１０と、ＲＡＭ１０から読み出された１つの画素に
ついてのＲＧＢの画像データをアナログ画像信号にそれ
ぞれ変換するＤＡＣ２１〜２３と、ＤＡＣ２１〜２３か
ら出力されたアナログ画像信号をそれぞれ増幅するオペ
アンプ３１〜３３とを含む液晶駆動回路が示されてい
る。
表示装置の一部を示す。図７には、赤色（Ｒ）、緑色
（Ｇ）、青色（Ｂ）の画像データを一時的に記憶するＲ
ＡＭ１０と、ＲＡＭ１０から読み出された１つの画素に
ついてのＲＧＢの画像データをアナログ画像信号にそれ
ぞれ変換するＤＡＣ２１〜２３と、ＤＡＣ２１〜２３か
ら出力されたアナログ画像信号をそれぞれ増幅するオペ
アンプ３１〜３３とを含む液晶駆動回路が示されてい
る。
【０００４】オペアンプ３１〜３３によって増幅された
アナログ画像信号は、液晶表示装置に含まれているＬＣ
Ｄパネルの複数のドットを駆動するＴＦＴ１１１、１２
１、・・・のソースライン１０１と、ＴＦＴ１１２、１
２２、・・・のソースライン１０２と、ＴＦＴ１１３、
１２３、・・・のソースライン１０３とにそれぞれ供給
される。コンデンサＣ１１、Ｃ２１、・・・、Ｃ１２、
Ｃ２２、・・・、Ｃ１３、Ｃ２３、・・・は、ＬＣＤパ
ネルのそれぞれのドットの容量を表している。
アナログ画像信号は、液晶表示装置に含まれているＬＣ
Ｄパネルの複数のドットを駆動するＴＦＴ１１１、１２
１、・・・のソースライン１０１と、ＴＦＴ１１２、１
２２、・・・のソースライン１０２と、ＴＦＴ１１３、
１２３、・・・のソースライン１０３とにそれぞれ供給
される。コンデンサＣ１１、Ｃ２１、・・・、Ｃ１２、
Ｃ２２、・・・、Ｃ１３、Ｃ２３、・・・は、ＬＣＤパ
ネルのそれぞれのドットの容量を表している。
【０００５】このように、従来の液晶駆動回路は、液晶
表示装置のソースライン数と同数のＤＡＣ（Digital to
Analog Converter：ディジタル／アナログ変換器）及
びオペアンプを有していたため、オペアンプの静止電流
による消費電力の増加や、チップ面積の増大が問題とな
っていた。
表示装置のソースライン数と同数のＤＡＣ（Digital to
Analog Converter：ディジタル／アナログ変換器）及
びオペアンプを有していたため、オペアンプの静止電流
による消費電力の増加や、チップ面積の増大が問題とな
っていた。
【０００６】ところで、特開平５−２０４３３４号公報
には、オペアンプの数を減らした液晶駆動回路が開示さ
れている。この液晶駆動回路は、映像データを保持する
データ保持手段と、複数の信号線のそれぞれに対応する
データ保持手段に保持されているデータを時分割で切替
えて増幅し、信号線のそれぞれに対応する出力線に時分
割して出力する増幅手段とを備えている。しかしなが
ら、この液晶駆動回路においては、オペアンプの数を減
らすことはできても、ＤＡＣの数を減らすことはできな
い。
には、オペアンプの数を減らした液晶駆動回路が開示さ
れている。この液晶駆動回路は、映像データを保持する
データ保持手段と、複数の信号線のそれぞれに対応する
データ保持手段に保持されているデータを時分割で切替
えて増幅し、信号線のそれぞれに対応する出力線に時分
割して出力する増幅手段とを備えている。しかしなが
ら、この液晶駆動回路においては、オペアンプの数を減
らすことはできても、ＤＡＣの数を減らすことはできな
い。
【０００７】また、特開平１１−１７５０４２号公報に
は、ＤＡＣの数を減らした液晶駆動回路が開示されてい
る。この液晶駆動回路は、デコーダでデータをディジタ
ル信号からアナログ信号に変える前に、マルチプレクサ
で特定のチャンネルを選択して、その選択した特定のチ
ャンネルのデータをデコードすることを繰り返し行い、
それを再びデマルチプレクシングするものである。しか
しながら、この液晶駆動回路においては、ＤＡＣの数を
減らすことはできても、出力バッファ部（オペアンプに
相当する）の数を減らすことはできない。さらに、マル
チプレクサ及びデマルチプレクサの他に、デマルチプレ
クサの後段において複数のチャンネルの画像データを保
持するための第２ラッチ部が必要になってしまう。
は、ＤＡＣの数を減らした液晶駆動回路が開示されてい
る。この液晶駆動回路は、デコーダでデータをディジタ
ル信号からアナログ信号に変える前に、マルチプレクサ
で特定のチャンネルを選択して、その選択した特定のチ
ャンネルのデータをデコードすることを繰り返し行い、
それを再びデマルチプレクシングするものである。しか
しながら、この液晶駆動回路においては、ＤＡＣの数を
減らすことはできても、出力バッファ部（オペアンプに
相当する）の数を減らすことはできない。さらに、マル
チプレクサ及びデマルチプレクサの他に、デマルチプレ
クサの後段において複数のチャンネルの画像データを保
持するための第２ラッチ部が必要になってしまう。
【０００８】
【発明が解決しようとする課題】そこで、上記の点に鑑
み、本発明は、余計なラッチ回路を追加することなくＤ
ＡＣ及びオペアンプの数を減少させることにより、消費
電力やチップ面積を抑えた液晶駆動回路を提供すること
を目的とする。
み、本発明は、余計なラッチ回路を追加することなくＤ
ＡＣ及びオペアンプの数を減少させることにより、消費
電力やチップ面積を抑えた液晶駆動回路を提供すること
を目的とする。
【０００９】
【課題を解決するための手段】以上の課題を解決するた
め、本発明に係る液晶駆動回路は、入力された画像デー
タを一時的に記憶する記憶回路と、記憶回路から読み出
された複数チャンネルの画像データを順次選択して時分
割で出力する第１の選択回路と、第１の選択回路から時
分割で出力された画像データをアナログ画像信号に変換
するディジタル／アナログ変換回路と、ディジタル／ア
ナログ変換回路によって得られたアナログ画像信号を増
幅する増幅回路と、複数の出力端子を順次選択すること
により、増幅回路によって増幅されたアナログ画像信号
を複数の出力端子に時分割で分配する第２の選択回路と
を具備する。
め、本発明に係る液晶駆動回路は、入力された画像デー
タを一時的に記憶する記憶回路と、記憶回路から読み出
された複数チャンネルの画像データを順次選択して時分
割で出力する第１の選択回路と、第１の選択回路から時
分割で出力された画像データをアナログ画像信号に変換
するディジタル／アナログ変換回路と、ディジタル／ア
ナログ変換回路によって得られたアナログ画像信号を増
幅する増幅回路と、複数の出力端子を順次選択すること
により、増幅回路によって増幅されたアナログ画像信号
を複数の出力端子に時分割で分配する第２の選択回路と
を具備する。
【００１０】ここで、ディジタル／アナログ変換回路
は、第１の選択回路から時分割で出力された画像データ
を、γ補正が施されたアナログ画像信号に変換する抵抗
回路網型ディジタル／アナログ変換器であっても良い。
は、第１の選択回路から時分割で出力された画像データ
を、γ補正が施されたアナログ画像信号に変換する抵抗
回路網型ディジタル／アナログ変換器であっても良い。
【００１１】また、第２の選択回路は、増幅回路によっ
て増幅されたアナログ画像信号を、複数の出力端子を介
して、液晶表示装置の複数のＴＦＴ（薄膜トランジス
タ）に時分割で分配するようにしても良い。
て増幅されたアナログ画像信号を、複数の出力端子を介
して、液晶表示装置の複数のＴＦＴ（薄膜トランジス
タ）に時分割で分配するようにしても良い。
【００１２】さらに、増幅回路は、ディジタル／アナロ
グ変換回路によって得られたアナログ画像信号に従って
第１の電源電位から出力点に向けて電流を流すＰチャネ
ルトランジスタを含むＰ型増幅器と、ディジタル／アナ
ログ変換回路によって得られたアナログ画像信号に従っ
て出力点から第２の電源電位に向けて電流を流すＮチャ
ネルトランジスタを含むＮ型増幅器と、Ｐ型増幅器の出
力点から出力されるアナログ画像信号とＮ型増幅器の出
力点から出力されるアナログ画像信号とを交互に切り換
える第３の選択回路とを含むようにしても良い。
グ変換回路によって得られたアナログ画像信号に従って
第１の電源電位から出力点に向けて電流を流すＰチャネ
ルトランジスタを含むＰ型増幅器と、ディジタル／アナ
ログ変換回路によって得られたアナログ画像信号に従っ
て出力点から第２の電源電位に向けて電流を流すＮチャ
ネルトランジスタを含むＮ型増幅器と、Ｐ型増幅器の出
力点から出力されるアナログ画像信号とＮ型増幅器の出
力点から出力されるアナログ画像信号とを交互に切り換
える第３の選択回路とを含むようにしても良い。
【００１３】その場合には、第１〜第３の選択回路の切
換タイミングが同期するように第１〜第３の選択回路を
制御する制御回路をさらに具備するようにしても良い。
また、第２及び第３の選択回路が、Ｐ型増幅器の出力点
から出力されるアナログ画像信号とＮ型増幅器の出力点
から出力されるアナログ画像信号とを交互に選択して、
液晶表示装置の複数のＴＦＴ（薄膜トランジスタ）に時
分割で分配するようにしても良い。ここで、Ｐ型増幅器
の出力点から出力されるアナログ画像信号が分配される
ＴＦＴを有するドットとＮ型増幅器の出力点から出力さ
れるアナログ画像信号が分配されるＴＦＴを有するドッ
トとが、直交する２つの方向において互いに隣接してい
ることが望ましい。
換タイミングが同期するように第１〜第３の選択回路を
制御する制御回路をさらに具備するようにしても良い。
また、第２及び第３の選択回路が、Ｐ型増幅器の出力点
から出力されるアナログ画像信号とＮ型増幅器の出力点
から出力されるアナログ画像信号とを交互に選択して、
液晶表示装置の複数のＴＦＴ（薄膜トランジスタ）に時
分割で分配するようにしても良い。ここで、Ｐ型増幅器
の出力点から出力されるアナログ画像信号が分配される
ＴＦＴを有するドットとＮ型増幅器の出力点から出力さ
れるアナログ画像信号が分配されるＴＦＴを有するドッ
トとが、直交する２つの方向において互いに隣接してい
ることが望ましい。
【００１４】このように構成した本発明に係る液晶駆動
回路によれば、第１及び第２の切換回路を用いて、ディ
ジタル／アナログ変換回路の前段及び増幅回路の後段で
画像信号を切り換えるので、余計なラッチ回路を追加す
ることなくＤＡＣ及びオペアンプの数を減少させること
が可能である。従って、液晶駆動回路の消費電力やチッ
プ面積を低減することができる。
回路によれば、第１及び第２の切換回路を用いて、ディ
ジタル／アナログ変換回路の前段及び増幅回路の後段で
画像信号を切り換えるので、余計なラッチ回路を追加す
ることなくＤＡＣ及びオペアンプの数を減少させること
が可能である。従って、液晶駆動回路の消費電力やチッ
プ面積を低減することができる。
【００１５】
【発明の実施の形態】以下、本発明の実施の形態につい
て、図面を参照しながら詳しく説明する。なお、同一の
構成要素には同一の参照番号を付して、説明を省略す
る。図１に、本発明の第１の実施形態に係る液晶駆動回
路と液晶表示装置との接続関係を示す。液晶表示装置１
００は、複数のドットに対応して複数のＴＦＴが２次元
マトリクス状に配置されたＬＣＤパネルを有する。液晶
表示装置１００を駆動するために、液晶駆動回路（ソー
スドライバ）２００が複数のＴＦＴのソースラインに接
続され、ゲートドライバ３００が複数のＴＦＴのゲート
ラインに接続されている。
て、図面を参照しながら詳しく説明する。なお、同一の
構成要素には同一の参照番号を付して、説明を省略す
る。図１に、本発明の第１の実施形態に係る液晶駆動回
路と液晶表示装置との接続関係を示す。液晶表示装置１
００は、複数のドットに対応して複数のＴＦＴが２次元
マトリクス状に配置されたＬＣＤパネルを有する。液晶
表示装置１００を駆動するために、液晶駆動回路（ソー
スドライバ）２００が複数のＴＦＴのソースラインに接
続され、ゲートドライバ３００が複数のＴＦＴのゲート
ラインに接続されている。
【００１６】液晶駆動回路２００においては、主な構成
要素として、後で詳しく説明するＲＡＭ、制御回路、Ｄ
ＡＣ、オペアンプ等の他に、入力端子及び出力端子と、
ゲートドライバへの出力端子とが配置されている。
要素として、後で詳しく説明するＲＡＭ、制御回路、Ｄ
ＡＣ、オペアンプ等の他に、入力端子及び出力端子と、
ゲートドライバへの出力端子とが配置されている。
【００１７】図２に、本発明の第１の実施形態に係る液
晶駆動回路の一部と液晶表示装置の一部を示す。液晶駆
動回路は、入力された画像データを一時的に記憶するＲ
ＡＭ１０と、ＲＡＭ１０から読み出された複数チャンネ
ルの画像データを順次選択して時分割で出力するスイッ
チ４１〜４３（第１の選択回路）と、スイッチ４１〜４
３から時分割で出力された画像データをアナログ画像信
号に変換するＤＡＣ２０と、ＤＡＣ２０によって得られ
たアナログ画像信号を増幅するオペアンプ３０と、複数
の出力端子を順次選択することにより、増幅回路によっ
て増幅されたアナログ画像信号を複数の出力端子に時分
割で分配するスイッチ５１〜５３（第２の選択回路）
と、各部の制御を行う制御回路６０とを含んでいる。
晶駆動回路の一部と液晶表示装置の一部を示す。液晶駆
動回路は、入力された画像データを一時的に記憶するＲ
ＡＭ１０と、ＲＡＭ１０から読み出された複数チャンネ
ルの画像データを順次選択して時分割で出力するスイッ
チ４１〜４３（第１の選択回路）と、スイッチ４１〜４
３から時分割で出力された画像データをアナログ画像信
号に変換するＤＡＣ２０と、ＤＡＣ２０によって得られ
たアナログ画像信号を増幅するオペアンプ３０と、複数
の出力端子を順次選択することにより、増幅回路によっ
て増幅されたアナログ画像信号を複数の出力端子に時分
割で分配するスイッチ５１〜５３（第２の選択回路）
と、各部の制御を行う制御回路６０とを含んでいる。
【００１８】制御回路６０の制御の下で、スイッチ４１
〜４３は、ＲＡＭ１０から読み出されたＲＧＢの３つの
チャンネルの画像データを順次選択する。１水平同期期
間（１Ｈ）において、ＲＧＢの画像データが時分割で順
次選択される。
〜４３は、ＲＡＭ１０から読み出されたＲＧＢの３つの
チャンネルの画像データを順次選択する。１水平同期期
間（１Ｈ）において、ＲＧＢの画像データが時分割で順
次選択される。
【００１９】スイッチ４１〜４３によって選択された画
像データは、ＤＡＣ２０によりアナログ画像信号に変換
される。ここで、ＤＡＣ２０は、複数の抵抗を用いた抵
抗回路網型ＤＡＣであり、これらの抵抗の抵抗値をγ補
正の特性を持たせた値に設定することにより、入力され
た画像データをγ補正が施されたアナログ画像信号に変
換することができる。
像データは、ＤＡＣ２０によりアナログ画像信号に変換
される。ここで、ＤＡＣ２０は、複数の抵抗を用いた抵
抗回路網型ＤＡＣであり、これらの抵抗の抵抗値をγ補
正の特性を持たせた値に設定することにより、入力され
た画像データをγ補正が施されたアナログ画像信号に変
換することができる。
【００２０】ＤＡＣ２０から出力されたアナログ画像信
号は、オペアンプ３０に入力されて増幅される。オペア
ンプ３０から出力されたアナログ画像信号は、スイッチ
５１〜５３によって、複数の出力端子を介して液晶表示
装置のソースライン１０１〜１０３に順次出力される。
スイッチ５１〜５３の切換タイミングは、スイッチ４１
〜４３の切換タイミングと同期するように、制御回路６
０によって制御される。
号は、オペアンプ３０に入力されて増幅される。オペア
ンプ３０から出力されたアナログ画像信号は、スイッチ
５１〜５３によって、複数の出力端子を介して液晶表示
装置のソースライン１０１〜１０３に順次出力される。
スイッチ５１〜５３の切換タイミングは、スイッチ４１
〜４３の切換タイミングと同期するように、制御回路６
０によって制御される。
【００２１】液晶表示装置においては、複数のＴＦＴ
が、ＬＣＤパネルの対応するドットをそれぞれ駆動す
る。ソースライン１０１は、ＴＦＴ１１１、１２１、・
・・のソースに接続され、ソースライン１０２は、ＴＦ
Ｔ１１２、１２２、・・・のソースに接続され、ソース
ライン１０３は、ＴＦＴ１１３、１２３、・・・のソー
スに接続されている。１つのソースラインに接続されて
いる複数のトランジスタの内、ゲートラインがハイレベ
ルとなっているトランジスタが活性化され、そのトラン
ジスタに接続されているドットにアナログ画像信号が供
給される。なお、コンデンサＣ１１、Ｃ２１、・・・、
Ｃ１２、Ｃ２２、・・・、Ｃ１３、Ｃ２３、・・・は、
ＬＣＤパネルのそれぞれのドットの容量を表している。
が、ＬＣＤパネルの対応するドットをそれぞれ駆動す
る。ソースライン１０１は、ＴＦＴ１１１、１２１、・
・・のソースに接続され、ソースライン１０２は、ＴＦ
Ｔ１１２、１２２、・・・のソースに接続され、ソース
ライン１０３は、ＴＦＴ１１３、１２３、・・・のソー
スに接続されている。１つのソースラインに接続されて
いる複数のトランジスタの内、ゲートラインがハイレベ
ルとなっているトランジスタが活性化され、そのトラン
ジスタに接続されているドットにアナログ画像信号が供
給される。なお、コンデンサＣ１１、Ｃ２１、・・・、
Ｃ１２、Ｃ２２、・・・、Ｃ１３、Ｃ２３、・・・は、
ＬＣＤパネルのそれぞれのドットの容量を表している。
【００２２】図３に、オペアンプ３０の出力電圧の時間
による変化を示す。オペアンプ３０は、１水平同期期間
内において、ＲＧＢの３つのチャンネルのアナログ画像
信号を時分割で順次出力する。図３に示すように、オペ
アンプ３０の出力電圧が本来の値となるまでには、ある
程度のセトリングタイムが必要である。
による変化を示す。オペアンプ３０は、１水平同期期間
内において、ＲＧＢの３つのチャンネルのアナログ画像
信号を時分割で順次出力する。図３に示すように、オペ
アンプ３０の出力電圧が本来の値となるまでには、ある
程度のセトリングタイムが必要である。
【００２３】ＬＣＤパネルのそれぞれのドットにおい
て、オペアンプ３０の出力電圧が本来の値となった後
で、その電圧がドットの容量によって保持される。従っ
て、スイッチがオープン状態となっても、それぞれのド
ットにおいては、オペアンプ３０から供給されたアナロ
グ画像信号のレベルが、次のアナログ画像信号に置き換
えられるまで保持される。
て、オペアンプ３０の出力電圧が本来の値となった後
で、その電圧がドットの容量によって保持される。従っ
て、スイッチがオープン状態となっても、それぞれのド
ットにおいては、オペアンプ３０から供給されたアナロ
グ画像信号のレベルが、次のアナログ画像信号に置き換
えられるまで保持される。
【００２４】このように、液晶駆動回路において切換動
作を行うことにより、ＲＧＢの３つのチャンネルについ
て必要なＤＡＣ及びオペアンプを１組とすることができ
る。また、チャンネルの切換周期は２０μ秒程度であり
（携帯電話向けＬＣＤパネルの場合には、１Ｈ＝６０μ
〜７０μ秒程度としても良い）、チャンネル切換のため
に高周波回路を必要としない。さらに、液晶表示装置に
おいてゲートラインは従来通りで良く、ソースドライバ
の変更のみ行えば済むため、容易に実現することが可能
である。なお、本実施形態においては、１つの選択回路
によって３つのチャンネルを切り換える場合について説
明したが、１つの選択回路によって切り換えるチャンネ
ル数は、２つ又は４つ以上でも良い。
作を行うことにより、ＲＧＢの３つのチャンネルについ
て必要なＤＡＣ及びオペアンプを１組とすることができ
る。また、チャンネルの切換周期は２０μ秒程度であり
（携帯電話向けＬＣＤパネルの場合には、１Ｈ＝６０μ
〜７０μ秒程度としても良い）、チャンネル切換のため
に高周波回路を必要としない。さらに、液晶表示装置に
おいてゲートラインは従来通りで良く、ソースドライバ
の変更のみ行えば済むため、容易に実現することが可能
である。なお、本実施形態においては、１つの選択回路
によって３つのチャンネルを切り換える場合について説
明したが、１つの選択回路によって切り換えるチャンネ
ル数は、２つ又は４つ以上でも良い。
【００２５】次に、本発明の第２の実施形態に係る液晶
駆動回路について説明する。本実施形態においては、図
２に示すオペアンプ３０の替わりに、図４に示す増幅回
路を用いている。それ以外の点に関しては、第１の実施
形態と同じである。
駆動回路について説明する。本実施形態においては、図
２に示すオペアンプ３０の替わりに、図４に示す増幅回
路を用いている。それ以外の点に関しては、第１の実施
形態と同じである。
【００２６】図４に示す増幅回路は、トランジスタＱ１
１〜Ｑ１７及びコンデンサＣ１を含むＮ型オペアンプ３
１と、トランジスタＱ２１〜Ｑ２７及びコンデンサＣ２
を含むＰ型オペアンプ３２と、Ｎ型オペアンプ３１の出
力信号とＰ型オペアンプ３２の出力信号とを交互に切り
換えるトランスミッションゲート３３及び３４（第３の
選択回路）とを有している。
１〜Ｑ１７及びコンデンサＣ１を含むＮ型オペアンプ３
１と、トランジスタＱ２１〜Ｑ２７及びコンデンサＣ２
を含むＰ型オペアンプ３２と、Ｎ型オペアンプ３１の出
力信号とＰ型オペアンプ３２の出力信号とを交互に切り
換えるトランスミッションゲート３３及び３４（第３の
選択回路）とを有している。
【００２７】Ｎ型オペアンプ３１は、入力信号ＶINを増
幅するＰチャネルトランジスタＱ１１及びＱ１２の差動
ペアと、増幅された入力信号に従って出力点ＯＵＴ１か
ら電源電位ＶSSに向けて電流を流すＮチャネルトランジ
スタＱ１６とを含んでいる。
幅するＰチャネルトランジスタＱ１１及びＱ１２の差動
ペアと、増幅された入力信号に従って出力点ＯＵＴ１か
ら電源電位ＶSSに向けて電流を流すＮチャネルトランジ
スタＱ１６とを含んでいる。
【００２８】一方、Ｐ型オペアンプ３２は、入力信号Ｖ
INを増幅するＮチャネルトランジスタＱ２１及びＱ２２
の差動ペアと、増幅された入力信号に従って電源電位Ｖ
DDから出力点ＯＵＴ２に向けて電流を流すＰチャネルト
ランジスタＱ２６とを含んでいる。
INを増幅するＮチャネルトランジスタＱ２１及びＱ２２
の差動ペアと、増幅された入力信号に従って電源電位Ｖ
DDから出力点ＯＵＴ２に向けて電流を流すＰチャネルト
ランジスタＱ２６とを含んでいる。
【００２９】Ｎ型オペアンプ３１及びＰ型オペアンプ３
２は、図８に示すようなＡＢ級のオペアンプよりも消費
電流が小さいという利点があるものの、Ｎ型オペアンプ
３１は出力信号を立ち上げる能力が低く立ち上がりエッ
ジが鈍ってしまい、Ｐ型オペアンプ３２は出力信号を立
ち下げる能力が低く立ち下がりエッジが鈍ってしまうと
いう欠点を有している。そこで、本実施形態において
は、Ｎ型オペアンプ３１とＰ型オペアンプ３２とを交互
に切り換えて使用している。
２は、図８に示すようなＡＢ級のオペアンプよりも消費
電流が小さいという利点があるものの、Ｎ型オペアンプ
３１は出力信号を立ち上げる能力が低く立ち上がりエッ
ジが鈍ってしまい、Ｐ型オペアンプ３２は出力信号を立
ち下げる能力が低く立ち下がりエッジが鈍ってしまうと
いう欠点を有している。そこで、本実施形態において
は、Ｎ型オペアンプ３１とＰ型オペアンプ３２とを交互
に切り換えて使用している。
【００３０】トランスミッションゲート３３は、イネー
ブル信号ＥＮがハイレベルで反転イネーブル信号ＥＮバ
ーがローレベルのときに、Ｎ型オペアンプ３１の出力点
ＯＵＴ１からの出力信号を通過させる。一方、トランス
ミッションゲート３４は、イネーブル信号ＥＰがハイレ
ベルで反転イネーブル信号ＥＰバーがローレベルのとき
に、Ｐ型オペアンプ３２の出力点ＯＵＴ２からの出力信
号を通過させる。これらの出力信号は、出力電圧ＶOUT
として出力される。
ブル信号ＥＮがハイレベルで反転イネーブル信号ＥＮバ
ーがローレベルのときに、Ｎ型オペアンプ３１の出力点
ＯＵＴ１からの出力信号を通過させる。一方、トランス
ミッションゲート３４は、イネーブル信号ＥＰがハイレ
ベルで反転イネーブル信号ＥＰバーがローレベルのとき
に、Ｐ型オペアンプ３２の出力点ＯＵＴ２からの出力信
号を通過させる。これらの出力信号は、出力電圧ＶOUT
として出力される。
【００３１】次に、液晶表示装置との関係において、Ｎ
型オペアンプ３１とＰ型オペアンプ３２との切り換えに
ついて説明する。図５は、液晶表示装置における印加電
位の反転を説明するための図である。ＬＣＤパネルの電
極は交流駆動する必要があるため、一方の電極に印加す
べき電位を第１の電位（“＋”で表す）と第２の電位
（“−”で表す）との間で反転させて駆動している。な
お、ＬＣＤパネルにおける画面の明度は、一方の電極に
印加される電位ではなく、両方の電極に印加される電位
差によって決定される。一般的な液晶表示装置における
印加電位の反転方法について、図５を参照しながら説明
する。
型オペアンプ３１とＰ型オペアンプ３２との切り換えに
ついて説明する。図５は、液晶表示装置における印加電
位の反転を説明するための図である。ＬＣＤパネルの電
極は交流駆動する必要があるため、一方の電極に印加す
べき電位を第１の電位（“＋”で表す）と第２の電位
（“−”で表す）との間で反転させて駆動している。な
お、ＬＣＤパネルにおける画面の明度は、一方の電極に
印加される電位ではなく、両方の電極に印加される電位
差によって決定される。一般的な液晶表示装置における
印加電位の反転方法について、図５を参照しながら説明
する。
【００３２】図５の（ａ）に示すフレーム反転において
は、全てのドットに印加される電位を１フレーム毎に反
転させている。図５の（ｂ）に示すライン反転において
は、１ライン毎に印加電位を反転させている。図５の
（ｃ）に示す列反転においては、１列毎に印加電位を反
転させている。図５の（ｄ）に示すドット反転において
は、１ドット毎に印加電位を反転させている。これらの
内、携帯電話等の小さい液晶表示装置においては、比較
的簡単に実現できるライン反転が用いられ、大型の液晶
表示装置においては、フリッカーが目立たないドット反
転が用いられる。
は、全てのドットに印加される電位を１フレーム毎に反
転させている。図５の（ｂ）に示すライン反転において
は、１ライン毎に印加電位を反転させている。図５の
（ｃ）に示す列反転においては、１列毎に印加電位を反
転させている。図５の（ｄ）に示すドット反転において
は、１ドット毎に印加電位を反転させている。これらの
内、携帯電話等の小さい液晶表示装置においては、比較
的簡単に実現できるライン反転が用いられ、大型の液晶
表示装置においては、フリッカーが目立たないドット反
転が用いられる。
【００３３】図６は、本実施形態に係る液晶駆動回路に
おけるドット走査を説明するための図である。図６にお
いては、ドットの位置を座標（行番号、列番号）で表し
ている。図６の（ａ）は、３つのチャンネルを切り換え
る場合のドット走査を示している。即ち、図２に示すス
イッチ４１〜４３（第１の選択回路）によって３つのチ
ャンネルの画像データが順次選択され、ＤＡ変換及び増
幅された後、スイッチ５１〜５３（第２の選択回路）に
よって液晶表示装置のＴＦＴの３つのソースラインに順
次出力される。
おけるドット走査を説明するための図である。図６にお
いては、ドットの位置を座標（行番号、列番号）で表し
ている。図６の（ａ）は、３つのチャンネルを切り換え
る場合のドット走査を示している。即ち、図２に示すス
イッチ４１〜４３（第１の選択回路）によって３つのチ
ャンネルの画像データが順次選択され、ＤＡ変換及び増
幅された後、スイッチ５１〜５３（第２の選択回路）に
よって液晶表示装置のＴＦＴの３つのソースラインに順
次出力される。
【００３４】ここで、図３に示すトランスミッションゲ
ート３３及び３４（第３の選択回路）の切換タイミング
は、第１及び第２の選択回路の切換タイミングと同期す
るように、制御回路６０（図２）によって制御される。
その結果、図３に示すＮ型オペアンプ３１とＰ型オペア
ンプ３２とが、１水平同期期間毎に交互に選択される。
これに対応するドット走査の順番を、（１、１）→
（２、１）→（３、１）→（１、２）→（２、２）→
（３、２）→（１、３）→（２、３）→（３、３）とす
ることにより、図６の（ｄ）に示すようにドット反転が
実現される。
ート３３及び３４（第３の選択回路）の切換タイミング
は、第１及び第２の選択回路の切換タイミングと同期す
るように、制御回路６０（図２）によって制御される。
その結果、図３に示すＮ型オペアンプ３１とＰ型オペア
ンプ３２とが、１水平同期期間毎に交互に選択される。
これに対応するドット走査の順番を、（１、１）→
（２、１）→（３、１）→（１、２）→（２、２）→
（３、２）→（１、３）→（２、３）→（３、３）とす
ることにより、図６の（ｄ）に示すようにドット反転が
実現される。
【００３５】図６の（ｂ）は、２つのチャンネルを切り
換える場合のドット走査を示している。この場合には、
図２に示すスイッチ４１及び４２によって２つのチャン
ネルの画像データが順次選択され、ＤＡ変換及び増幅さ
れた後、スイッチ５１及び５２によって液晶表示装置の
ＴＦＴの２つのソースラインに順次出力される。
換える場合のドット走査を示している。この場合には、
図２に示すスイッチ４１及び４２によって２つのチャン
ネルの画像データが順次選択され、ＤＡ変換及び増幅さ
れた後、スイッチ５１及び５２によって液晶表示装置の
ＴＦＴの２つのソースラインに順次出力される。
【００３６】ここで、図３に示すトランスミッションゲ
ート３３及び３４の切換タイミングは、第１及び第２の
選択回路の切換タイミングと同期するように、制御回路
６０（図２）によって制御される。その結果、図３に示
すＮ型オペアンプ３１とＰ型オペアンプ３２とが、１水
平同期期間毎に交互に選択される。これに対応するドッ
ト走査の順番を、（１、１）→（２、１）→（２、２）
→（１、２）→（１、３）→（２、３）→（２、４）→
（２、５）→（１、５）とすることにより、図６の
（ｄ）に示すようなドット反転が実現される。
ート３３及び３４の切換タイミングは、第１及び第２の
選択回路の切換タイミングと同期するように、制御回路
６０（図２）によって制御される。その結果、図３に示
すＮ型オペアンプ３１とＰ型オペアンプ３２とが、１水
平同期期間毎に交互に選択される。これに対応するドッ
ト走査の順番を、（１、１）→（２、１）→（２、２）
→（１、２）→（１、３）→（２、３）→（２、４）→
（２、５）→（１、５）とすることにより、図６の
（ｄ）に示すようなドット反転が実現される。
【００３７】即ち、上記のようなドット走査を行うこと
により、Ｎ型オペアンプ３１の出力信号が分配されるＴ
ＦＴを有するドットと、Ｐ型オペアンプ３２の出力信号
が分配されるＴＦＴを有するドットとが、直交する２つ
の方向において互いに隣接することになる。
により、Ｎ型オペアンプ３１の出力信号が分配されるＴ
ＦＴを有するドットと、Ｐ型オペアンプ３２の出力信号
が分配されるＴＦＴを有するドットとが、直交する２つ
の方向において互いに隣接することになる。
【００３８】
【発明の効果】以上述べた様に、本発明によれば、余計
なラッチ回路を追加することなくＤＡＣ及びオペアンプ
の数を減少させることが可能である。従って、液晶駆動
回路の消費電力やチップ面積を低減することができる。
さらに、液晶駆動回路のコストを低減させることができ
る。
なラッチ回路を追加することなくＤＡＣ及びオペアンプ
の数を減少させることが可能である。従って、液晶駆動
回路の消費電力やチップ面積を低減することができる。
さらに、液晶駆動回路のコストを低減させることができ
る。
【図１】本発明の第１の実施形態に係る液晶駆動回路と
液晶表示装置との接続を示す図である。
液晶表示装置との接続を示す図である。
【図２】本発明の第１の実施形態に係る液晶駆動回路の
一部と液晶表示装置の一部を示す図である。
一部と液晶表示装置の一部を示す図である。
【図３】図２に示すオペアンプの出力電圧の時間による
変化を示す図である。
変化を示す図である。
【図４】本発明の第２の実施形態に係る液晶駆動回路に
おいて用いられる増幅回路を示す回路図である。
おいて用いられる増幅回路を示す回路図である。
【図５】液晶表示装置における印加電位の反転を説明す
るための図である。
るための図である。
【図６】本発明の第２の実施形態に係る液晶駆動回路に
おけるドット走査を説明するための図である。
おけるドット走査を説明するための図である。
【図７】従来の液晶駆動回路の一部と液晶表示装置の一
部を示す図である。
部を示す図である。
【図８】従来の液晶駆動回路において用いられるオペア
ンプを示す回路図である。
ンプを示す回路図である。
１０ ＲＡＭ
２０ ＤＡＣ
３０ オペアンプ
３１ Ｎ型オペアンプ
３２ Ｐ型オペアンプ
３３、３４ トランスミッションゲート
４１〜４２、５１〜５２ スイッチ
６０ 制御回路
１００ 液晶表示装置
１０１〜１０３ ソースライン
１１１、１２１、・・・ ＬＣＤパネルの第１列のＴＦ
Ｔ １１２、１２２、・・・ ＬＣＤパネルの第２列のＴＦ
Ｔ １１３、１２３、・・・ ＬＣＤパネルの第３列のＴＦ
Ｔ ２００ 液晶駆動回路 ３００ ゲートドライバ Ｒ１・・・ 出力抵抗 Ｃ１、Ｃ２・・・ コンデンサ Ｃ１１、Ｃ２１・・・ ＬＣＤパネルの第１列のドット
容量 Ｃ１２、Ｃ２２・・・ ＬＣＤパネルの第２列のドット
容量 Ｃ１３、Ｃ２３・・・ ＬＣＤパネルの第３列のドット
容量 Ｑ１１〜Ｑ１８、Ｑ２１〜Ｑ２８・・・ トランジスタ
Ｔ １１２、１２２、・・・ ＬＣＤパネルの第２列のＴＦ
Ｔ １１３、１２３、・・・ ＬＣＤパネルの第３列のＴＦ
Ｔ ２００ 液晶駆動回路 ３００ ゲートドライバ Ｒ１・・・ 出力抵抗 Ｃ１、Ｃ２・・・ コンデンサ Ｃ１１、Ｃ２１・・・ ＬＣＤパネルの第１列のドット
容量 Ｃ１２、Ｃ２２・・・ ＬＣＤパネルの第２列のドット
容量 Ｃ１３、Ｃ２３・・・ ＬＣＤパネルの第３列のドット
容量 Ｑ１１〜Ｑ１８、Ｑ２１〜Ｑ２８・・・ トランジスタ
─────────────────────────────────────────────────────
フロントページの続き
(51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考）
Ｇ０９Ｇ 3/20 ６２３ Ｇ０９Ｇ 3/20 ６２３Ｄ
６２３Ｆ
６４１ ６４１Ｑ
６８０ ６８０Ｇ
Ｆターム(参考） 2H093 NA16 NA34 NA43 NC13 NC24
NC34 ND10 ND39 ND42 ND50
ND54 ND58
5C006 AA01 AA16 AA22 AC11 AC27
AC28 AF42 AF43 AF44 AF46
AF51 AF53 AF71 AF83 BB16
BC03 BC12 BC20 BF24 BF25
BF34 FA43 FA47 FA56
5C080 AA10 BB05 CC03 DD05 DD22
DD26 EE29 EE30 FF11 GG07
GG08 JJ02 JJ03 JJ04
Claims (7)
- 【請求項１】 入力された画像データを一時的に記憶す
る記憶回路と、 前記記憶回路から読み出された複数チャンネルの画像デ
ータを順次選択して時分割で出力する第１の選択回路
と、 前記第１の選択回路から時分割で出力された画像データ
をアナログ画像信号に変換するディジタル／アナログ変
換回路と、 前記ディジタル／アナログ変換回路によって得られたア
ナログ画像信号を増幅する増幅回路と、 複数の出力端子を順次選択することにより、前記増幅回
路によって増幅されたアナログ画像信号を前記複数の出
力端子に時分割で分配する第２の選択回路と、を具備す
る液晶駆動回路。 - 【請求項２】 前記ディジタル／アナログ変換回路が、
前記第１の選択回路から時分割で出力された画像データ
を、γ補正が施されたアナログ画像信号に変換する抵抗
回路網型ディジタル／アナログ変換器であることを特徴
とする請求項１記載の液晶駆動回路。 - 【請求項３】 前記第２の選択回路が、前記増幅回路に
よって増幅されたアナログ画像信号を、前記複数の出力
端子を介して、液晶表示装置の複数のＴＦＴ（薄膜トラ
ンジスタ）に時分割で分配することを特徴とする請求項
１又は２記載の液晶駆動回路。 - 【請求項４】 前記増幅回路が、 前記ディジタル／アナログ変換回路によって得られたア
ナログ画像信号に従って第１の電源電位から出力点に向
けて電流を流すＰチャネルトランジスタを含むＰ型増幅
器と、 前記ディジタル／アナログ変換回路によって得られたア
ナログ画像信号に従って出力点から第２の電源電位に向
けて電流を流すＮチャネルトランジスタを含むＮ型増幅
器と、 前記Ｐ型増幅器の出力点から出力されるアナログ画像信
号と前記Ｎ型増幅器の出力点から出力されるアナログ画
像信号とを交互に切り換える第３の選択回路と、を含む
ことを特徴とする請求項１〜３のいずれか１項記載の液
晶駆動回路。 - 【請求項５】 前記第１〜第３の選択回路の切換タイミ
ングが同期するように前記第１〜第３の選択回路を制御
する制御回路をさらに具備する請求項４記載の液晶駆動
回路。 - 【請求項６】 前記第２及び第３の選択回路が、前記Ｐ
型増幅器の出力点から出力されるアナログ画像信号と前
記Ｎ型増幅器の出力点から出力されるアナログ画像信号
とを交互に選択して、液晶表示装置の複数のＴＦＴ（薄
膜トランジスタ）に時分割で分配することを特徴とする
請求項４又は５記載の液晶駆動回路。 - 【請求項７】 前記Ｐ型増幅器の出力点から出力される
アナログ画像信号が分配されるＴＦＴを有するドットと
前記Ｎ型増幅器の出力点から出力されるアナログ画像信
号が分配されるＴＦＴを有するドットとが、直交する２
つの方向において互いに隣接していることを特徴とする
請求項６記載の液晶駆動回路。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2002008374A JP2003208132A (ja) | 2002-01-17 | 2002-01-17 | 液晶駆動回路 |
| US10/342,109 US7151520B2 (en) | 2002-01-17 | 2003-01-13 | Liquid crystal driver circuits |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2002008374A JP2003208132A (ja) | 2002-01-17 | 2002-01-17 | 液晶駆動回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2003208132A true JP2003208132A (ja) | 2003-07-25 |
Family
ID=27646650
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2002008374A Withdrawn JP2003208132A (ja) | 2002-01-17 | 2002-01-17 | 液晶駆動回路 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US7151520B2 (ja) |
| JP (1) | JP2003208132A (ja) |
Cited By (20)
| Publication number | Priority date | Publication date | Assignee | Title |
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| US8253861B2 (en) | 2004-10-20 | 2012-08-28 | Fujitsu Ten Limited | Display device, method of adjusting the image quality of the display device, device for adjusting the image quality and device for adjusting the contrast |
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